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本帖最后由 deargds 于 2019-10-14 12:04 编辑
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8 d. u8 T8 B! ?. D" t功能：将17.2 PCB降级到16.6版本
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; U+ r9 K( B" s s/ V+ u) GV1.2 更新内容：7 W1 T* J4 R8 h) V/ t
修复网表转换出错问题
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7 J* v, I8 k' \/ ?使用注意事项：5 [+ J+ T6 u$ e; T/ Q* y3 |
1.需要同时安装17.2和16.6版本，转换后的文件约束规则需要重新检查设置。
% Q& Q; Z. M# s/ {2.allegro17.2补丁版本需要在S028之后
% t, ]! u0 c6 \2 \. V, M3.Allegro16.6如果没有打过补丁，可能会导入失败
( w$ g6 p1 S0 L& q& d4.在Allegro16.6导入之前，请检查并设置封装库路径，如下图所示，在路径中包含有一行小数点即可，如果没有可以手工添加。8 e* s9 U3 W+ m3 y: g0 Q
5.本程序转换文件仅供参考使用, 如用于正式设计，建议重新导入网表。
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1.下载附件后，解压放入PCBENV目录下，在allegro.ilinit文件中添加一句
1 M5 m* G8 \. S6 M i: |( Cloadi(\"x_downrev17.il\" \"deargds\") ;请注意是否为英文引号及空格。2 o* R! k* t+ B/ f* S
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2.打开17.2版本的PCB文件,执行Command>downrev17命令, 选择数据导出的目录(建议使用默认目录)，然后执行导出。2 X& v3 a" [/ T4 J5 T4 x7 `
$ `/ G" I/ j( r3 I) f1 k6 V' j: s3.打开Allegro16.6软件,执行Command>downrev17命令，选择上一步17.2数据导出的目录位置，然后进行导入即可。
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2 ~0 G; `3 n% Q0 z0 B如果有其它问题及疑问可以回帖反馈。
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来源: [原创SKILL]Allegro 17.2版本PCB降级到16.6版本，更新V1.2版本 |
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发表于 2020-5-28 08:38
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发表于 2020-12-1 09:30
