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[Cadence Sigrity] 求助:PDN阻抗仿真,VRM和负载之间存在跳线怎么处理?

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1#
发表于 2020-4-30 11:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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求助:PDN阻抗仿真,VRM和负载之间存在跳线怎么处理?跳线之前还有一堆电容,怎么加到仿真网络中?十分感谢!: o- L- s, q5 {3 u

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3#
 楼主| 发表于 2020-4-30 13:40 | 只看该作者
hawkflior 发表于 2020-4-30 13:12) @* m3 o- n6 c% u4 D! F( |
设成0ohm

" b' a  E# d7 [* e0 F/ u. x' H是直接在component manager里面把模型设置成R=0ohm吗?8 n) y' c& \5 s+ k! u
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    4#
    发表于 2020-4-30 15:52 | 只看该作者
    设分立器件时,阻值设为0

    “来自电巢APP”

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    5#
    发表于 2020-5-4 10:33 | 只看该作者
    是的,参考磁珠做法

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    6#
    发表于 2020-5-4 11:52 | 只看该作者
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