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请教一下信号线为什么要这样接

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1#
发表于 2010-6-9 08:55 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
经常看到有些电路信号线上接个匹配电阻,在接个电容到地,有些是像图中的接法,请问下这样接对si有什么好处?

该用户从未签到

2#
发表于 2010-6-9 09:16 | 只看该作者
楼主提到的这种匹配方式是:差分的优化匹配方式---专门针对差分线的。
5 V2 T3 V& h4 B% }4 i---------------------------------------
' S9 p. O) H8 E' T/ _对于电路中的差分信号对,比如DDR 内存模块中的差分时钟信号,匹配通常需要考虑两方面的因素,( n' h. ~& w! F! Z6 A, }
即差模阻抗匹配和共模阻抗匹配。基于这两种匹配我们才能选择最终的匹配方案,如完全匹配、0 p- @0 L4 {4 z, L! q
优化匹配、简化匹配等。( `/ Y) }5 `! K- [9 |3 x8 _
[ 1 u( k- D- v- g( K% z
  [3 q2 D1 s+ M8 g. F1 }8 x' X
从上图中可以看出,差模信号的匹配只需用一个电阻,但对共模信号不起作用;而共模电阻匹配则
  I+ |. L$ p& O" }" x* B. n9 G8 S$ C可以匹配信号对中的共模分量,这可以使用在在共模信号影响较强的情况;而实际的差分走线中,
" y2 o, a8 c$ s$ J除了本身的差分信号之外,不可避免地会出现共模的分量,所以需要两种匹配的结合,完全匹配则6 r  s" I9 }) b2 W' @) X
是结合了两者的作用,能有效地消除各种反射噪声,但它的缺点是:需要器件较多,给电路增9 T6 V5 V1 r7 O/ [! B
加了额外的直流负载,同时要结合仿真计算阻值,并不是简单的将上面两种匹配形式的电阻进行组合。9 J+ \0 a, o6 |2 b# Z, E
如果对完全匹配进行进一步改进,我们可以得到另一种较好的针对差分对的优化匹配形式,1 H' M# W" n( t/ f5 U% k% W; M
它多采用了一个电容接地,可以降低电路的直流损耗,其匹配形如下图:; I; A" f' D1 T% ?* W$ S

+ @$ N$ ^' g  B: l9 a4 Y; U  [其中电阻R1 和R2 的值可以近似于传输线的阻抗,C1 的值确定和交流匹配形式中类似,
& F1 {( r, L/ m5 b6 X& C具体的值需要经过仿真后才能最终确定。

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3#
发表于 2010-6-9 19:45 | 只看该作者
楼上的说的很好. Q" }+ t6 ^" p. v
有时候还会共模端接和差模端接一起使用, T- c& h! B1 \9 R8 @% Y9 T
这就要看差分接收器结构了

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4#
发表于 2010-6-9 23:22 | 只看该作者
受教了!

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5#
发表于 2010-6-12 15:36 | 只看该作者
路过,学习中

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6#
 楼主| 发表于 2010-6-13 09:17 | 只看该作者
谢谢版主的解答。虽然对这个电路参数确定还不是很了解,但也有了一个感性认识。差分线还没用过,查了下资料,好像说差分线上各串一个电阻作匹配效果比较好。还有,那个电容是个旁路电容,应该是过滤高频噪声,而不是可以降低电路的直流损耗吧

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7#
发表于 2010-6-14 11:29 | 只看该作者
差分信号还分很多种,如LVDS,PECL.LVPECL,各种信号匹配的方法不太一样,
4 ~9 a9 D# z$ `+ ]+ t2 o$ _1 P附件的资料希望对大家有帮助。& h- ?1 r$ _- R' z( N+ A
  `: O; t) \- D
差分线对在高速PCB设计中的应用.pdf (138.93 KB, 下载次数: 412)

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8#
 楼主| 发表于 2010-6-17 11:47 | 只看该作者
论文看了,只介绍了LVDS和LVPECL,写得也比较简单。那么下图这两种接法,电容是不是也只是起到过滤高频噪声?这个电容应该要用很小的容量吧,大概数值一般是多少?   & O' b4 n; u: L* n4 q! o/ n+ h" ?1 U# S& T

  B, ]" t% F5 Y' ]/ k/ g

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9#
发表于 2010-6-18 09:35 | 只看该作者
本帖最后由 panhaojie 于 2010-6-18 09:57 编辑
! g, v7 Y- O0 j9 j# N) Z) O% {0 L
请教一个问题,针对RJ45网口的阻抗匹配中的两个电阻(49.9ohm/50ohm)各接一根信号线,再接一个电容0.1uF到地,根据沙发shark4685 的说法,“电阻R1 和R2 的值可以近似于传输线的阻抗传输线的阻抗”,那么阻抗传输线的阻抗有49.9ohm这么大吗?这个是如何算出来的?

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10#
发表于 2010-6-18 11:25 | 只看该作者
好帖 学习了

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11#
发表于 2010-6-18 11:30 | 只看该作者
本帖最后由 shark4685 于 2010-6-18 11:33 编辑
, i  A9 f) I, y" f( S: D+ I) T  m5 g

; Q6 e9 U& ~, y# Q+ g* @8楼的兄弟,电容滤波和容值大小的关系如上图。& k% G- f2 B9 l1 b* W3 @1 J
9楼的兄弟,传输线的阻抗计算方法% L6 l1 v2 y! B
https://www.eda365.com/viewthread.php?tid=135&from=recommend_f
  • TA的每日心情
    擦汗
    2024-7-15 15:55
  • 签到天数: 4 天

    [LV.2]偶尔看看I

    12#
    发表于 2010-6-23 22:43 | 只看该作者
    受教了
  • TA的每日心情
    开心
    2019-11-19 16:42
  • 签到天数: 1 天

    [LV.1]初来乍到

    13#
    发表于 2010-7-5 17:09 | 只看该作者
    像这样的电阻电容匹配应该靠近那一端?源端还是终端?对于RJ45 一对是发射一对是接收,这样匹配是否要放在不同的地方?

    该用户从未签到

    14#
    发表于 2010-7-7 09:25 | 只看该作者
    阻抗匹配的原则就是让所有回路上的阻抗都一致,但这种情况是理想状态,4 g* _, {, ]' s% f' M0 |
    一般根据实际情况在源端,或在末端匹配,消除反射,匹配方式是灵活多变的,/ x4 _5 v% G; t" U4 E( k  \
    一般通过仿真软件确认那种匹配方式最适合你目前做的电路。

    该用户从未签到

    15#
    发表于 2010-7-29 17:36 | 只看该作者
    回复 2# shark4685
    2 Z. e' ~8 K& k2 u6 v6 j4 [3 E: W+ V  E; t

    + s( _$ v& [7 {    这种匹配好像是针对共模信号的??
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