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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我刚刚开始学习allegro 有很多不懂的,象大家请教下!+ Y( B4 z" r. h5 u: z1 S/ `
; Q5 G+ R% P/ }5 i* P5 r$ m  H
     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!; {9 ~7 a5 A9 |4 V) h! y
     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?
2 @, U4 y* ^: B    3,在画PCB时我们怎么改变过孔?

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚" e9 [. z- e. ]. v
2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容+ m4 \/ ?% j- G/ l" M. q

; ?, B# s. c. [0 {' Q8 k3、添加多个孔,走线时用那个就选那个
+ v0 k6 q1 o8 k3 F       
! Q* p7 t! Q9 F* I& D* p8 J+ f% N& f0 K2 w/ c; C
或者给NET赋个属性 7 v0 g! O3 n# P$ p- Q# |
      
7 U8 C! Z) }0 e: x/ W  O" w& D8 c* t1 e: b( K7 @; {. t

0 s9 X: H* x! m, W% x$ S( t
5 }, E1 [' v$ n% c2 m如果是另外全部替换孔的 可以这样# C3 }1 d& Y0 {" t7 l1 a

1 F# z, T8 ]9 O7 D8 W
1 R: ^) D* O! L0 A: g8 H
; [8 K2 |+ t; A; h 其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表 ; ]; R1 u7 O1 O
2,网络重复命名也许会带来错误吧?

6 F7 u0 h4 f. h5 R" j" R: B7 p) k* _' L4 [$ q: S
我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表 0 H4 }- t* k1 j2 a4 K8 e# E
在同条网路上给两个名字连谈都不值得谈,因为没意义;

. j3 @: V2 f9 y& y3 t0 D
: _+ I, s( R5 ?$ q; H% a8 ~8 t. a) i哦~      ( Q6 S! ?; E7 w) s* T# z2 W  h
那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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