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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我刚刚开始学习allegro 有很多不懂的,象大家请教下!( E. O6 h( W' x1 V+ w8 l
% g( T& w/ }5 z& w
     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!
/ R& h% y% X7 u2 u4 P6 V9 h     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?
+ A0 \9 W, W: u1 ^6 t7 H( b    3,在画PCB时我们怎么改变过孔?

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kxx27 + 5 鼓励一下

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚
2 C/ }; c! n1 X5 i9 R2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容
6 x9 p$ }# i& m, n8 E& \
& U! B. ]* T" X( i- d3、添加多个孔,走线时用那个就选那个& C) H: [, A1 h8 u
      
7 G6 y  _  M. N$ t. y* C! ]2 L; ?  V( b/ h- k5 J9 O) l
或者给NET赋个属性
4 j% |( E- e, r5 n$ m        8 z8 b; A+ O) h+ i

; m- B, G: _3 A 7 v0 \$ x  X7 i, s2 J" N) @

. |3 a7 J9 q2 k( A' n  x如果是另外全部替换孔的 可以这样
! G3 q3 O6 i% d, L: u 6 i2 g) @$ o; e1 j# H1 j3 w
/ F+ s- Z9 h$ v* w

! x+ i/ ~, o  H2 B! s4 ? 其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表 1 T' q' }+ f  b- W
2,网络重复命名也许会带来错误吧?
. a8 [) v" ^8 a- C+ U7 x2 V. C

' D& B5 s. g0 P( I) v我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表
+ E5 h9 K/ e0 l: c) l3 `在同条网路上给两个名字连谈都不值得谈,因为没意义;

) h& R7 y1 I. {, r. m+ v; D2 F
' p* y: C# d+ e; t) {" |+ Z( J5 G) {哦~      , y5 q& Y& }% ?! k; W; U0 I6 _
那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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