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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我刚刚开始学习allegro 有很多不懂的,象大家请教下!7 o+ @8 r) Y# l" m" b2 ]
$ T" D+ S( e" ~1 `! Z9 T
     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!
6 }% g2 v* }: w1 Y1 x     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?
) s! D# y- [/ |6 F- ^2 Y    3,在画PCB时我们怎么改变过孔?

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kxx27 + 5 鼓励一下

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚, n) s& {; i) o. U# q# Z3 p
2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容
2 m3 r, _: v# V8 Y4 A8 J" ]
) C! W& k. ^# J$ o/ c3、添加多个孔,走线时用那个就选那个: \% T  p  V( F6 A
      
; c- u6 k0 T1 P9 W0 M5 P! U3 [- y0 B8 K! L
或者给NET赋个属性 # F- X* @  b$ W7 W/ z/ T3 M1 D
      
/ c0 g+ p# O8 O5 Y, i! e/ @% n% _9 _3 j# r3 `( C5 R
. r+ S% k$ |1 |: L# J/ L4 V9 j
, G, b) g% H! @5 N/ Z' l; Y3 X: ~
如果是另外全部替换孔的 可以这样
' T! @4 g- y# m ; M! O  v0 r8 T% V" Y
5 P" ~& ]/ s9 H; `6 i- }
7 V- b! R7 |/ A$ [) J
其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表 : }9 n' ?8 z3 Y$ \4 I
2,网络重复命名也许会带来错误吧?

' m5 B* b! u( h& s
1 o; y. P5 X, ?) `8 R我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表
7 M7 g2 _3 P) U( m4 e在同条网路上给两个名字连谈都不值得谈,因为没意义;
0 N% l% D) g% H5 N( ]" n' g
4 t  {" ]$ @  g3 ]) }9 y
哦~      
3 q& A% L/ u! q, r, Y那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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