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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我刚刚开始学习allegro 有很多不懂的,象大家请教下!" L  m; T7 Q" @; Z' \
8 n( F1 i" |/ d5 |4 y9 H" P+ W
     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!  ^( N1 Z/ q" l
     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?! D% ?* _2 L: B2 c; W
    3,在画PCB时我们怎么改变过孔?

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kxx27 + 5 鼓励一下

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚8 _/ q1 T7 k  i( O3 \2 |
2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容: r4 M/ m% ^8 J) W- l

3 e: n8 r4 Q  ?8 o( [; @3、添加多个孔,走线时用那个就选那个
1 Q+ U, T0 r: y& F6 J; w7 c! C        % m! E6 t* p$ a1 O$ _
( }: y6 l9 M6 r5 _9 S7 R
或者给NET赋个属性 1 ^1 j5 O* Q! x9 E* b/ w3 B& G" [
      
0 S8 [# D0 O6 g) ]0 u6 a% k5 ]3 P1 X% O2 F) e' \' q) Y

$ X( {( y% `/ f1 T$ `! _2 ~6 P- ~
/ w% k3 [) M) J$ z7 g) m如果是另外全部替换孔的 可以这样# j) R6 @5 a0 ^4 P

7 [& e' J$ {" X2 u( r' X  `# M! L! v% ]  T( J3 r

0 O* N' X; [- R& e! M! Q1 b0 g 其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表
) `# K- \% b! b% ^2,网络重复命名也许会带来错误吧?

1 k) j( w' K" d; F
; ^$ a1 k; ~6 i' M" X; c, A& E* @我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表 / c; D  G" c3 h6 K, ~, Q8 B
在同条网路上给两个名字连谈都不值得谈,因为没意义;
% [4 p  z! y- A5 j, E  H& F
0 e! \  W: _& T) c  Y
哦~      $ V8 x; g3 Y! l4 B
那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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