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1#
发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我刚刚开始学习allegro 有很多不懂的,象大家请教下!
' d7 M1 r0 S' o$ b5 [% K7 z" |+ S
     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!/ m" \- g/ m+ C4 C% f
     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?6 N; l7 l! M' f3 H1 j
    3,在画PCB时我们怎么改变过孔?

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该用户从未签到

2#
发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚
3 _/ k, F4 L5 r; l2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容
1 z, Y/ X. Q2 D& F4 z) H% H
+ Q9 z; {) v6 f3、添加多个孔,走线时用那个就选那个
" K; Q& V, ]+ ^! U- Q% ~        4 j1 b5 E8 C. `4 s( r- r

4 D( A. J& V( v" K* ]! E. p或者给NET赋个属性
" G3 m0 ]( s" o" b% ]9 o       
2 [2 T, m' x' J* N
" C2 T- j0 `6 H 6 p% C3 D. Q# s) d! R8 V

5 R3 q* h2 m2 p/ T, G/ a$ [8 t如果是另外全部替换孔的 可以这样
8 \/ d, t! w7 u) O. M, M 8 ?5 t2 `) q1 m8 w5 P2 [: a

9 ]$ q- V" l$ ]% z+ q( t8 S' ~! Q$ J8 ]3 @% n( a
其它的不懂了   收工

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numbdemon + 5 Good
kxx27 + 5 感谢这么认真的回贴!

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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4#
发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表
! w6 z2 p8 d' s9 x; j* p2,网络重复命名也许会带来错误吧?

7 N" @( W' k" }6 k, O! Y
* e+ z" G6 J1 ?4 ~7 @我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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5#
发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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6#
发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表 ( {7 F. n8 B# t, h( \' m# b) i  F
在同条网路上给两个名字连谈都不值得谈,因为没意义;
6 ^, L  j' r/ a# M5 N0 H$ v
6 {4 J) i, z  K7 s3 ?2 c4 ^2 L
哦~      
7 J& ^% I0 [5 f& p那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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