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求解,17.2没有创建Xnet, CM管理器中却有很多Xnet网络,怎么删除?

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  • TA的每日心情
    开心
    2020-6-23 15:00
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    [LV.5]常住居民I

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    1#
    发表于 2020-2-6 14:46 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    如题,求解,cadence17.2版本,画图过程我并没有创建Xnet, 但在orcadallegro的CM规则管理器中却有很多Xnet网络,怎么去掉这些Xnet网络?+ f, c) Z- s+ f, H

    ' _& a7 g3 z% `# E# G, `7 g: A

    Orcad_CM.png (119.02 KB, 下载次数: 10)

    Orcad_CM.png

    Allegro_CM.png (133.65 KB, 下载次数: 12)

    Allegro_CM.png

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    发表于 2022-1-24 17:30 | 只看该作者
    本帖最后由 lpxv 于 2022-1-24 17:38 编辑 % o; Y3 h! }) D
    0 d. [1 W. k" O: m" F( ~( P4 H
    楼下回复了解决办法。
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     楼主| 发表于 2020-2-6 20:26 | 只看该作者
    我同时用2个DSN文件试了一下,没有打开过规则管理器的DSN文件,是有Ignore Electrical constraints这个选项的,打开过规则管理器的DSN文件连这个选项都没有了。我用钩选了Ignore Electrical constraints这个选项生成的网表导到入旧的PCB,也更新不了PCB上Xnet网络。(导入到全新的PCB文件下,是没有Xnet的。); ?4 t# K$ b0 `+ v
    9 {; f8 P  i8 B6 G$ ^
    * m* D' p' Y- M* U$ Z) ^
    不过问题不在这里,复制和新建一个原理图很快很容易,但是PCB已经完成了一半,在完成的PCB文件上,更新不了这个Xnet, 甚至有些网络都没有,导致PCB的规则都设置不了,5 ^/ {. {# L* G+ P) W2 |* m

    9 ~. a" T3 n0 q应该在Allegro上能删除才对。
    ; g# _; U# X3 }' d. i" l

    Setup.png (51.16 KB, 下载次数: 7)

    Setup.png

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    发表于 2022-1-24 17:31 | 只看该作者
    lc_0755 发表于 2020-2-8 15:27- R/ e% [: l% D* ]+ Q
    我原来在用16.6的时候,Tools菜单下是没有Constraint Manager这一栏的,17.2版本新增了这个功能,但是可能 ...
    , Z+ u; \0 N: W; _1 f
    5楼是正确的解决办法,只是还少了最后一步,就是在PCB中的Tool->Database Check-> Regenerate Xnet ,这样就可以完美解决了。1 E1 C' H1 k% Y% r9 ?- a: a
    另外,Candence论坛也有大佬解决方案,标题是“Xnet issue in orcad pcb designer 17.2”,地址是:https://community.cadence.com/cadence_technology_forums/pcb-design/f/pcb-editor-skill/43569/xnet-issue-in-orcad-pcb-designer-17-2
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    2#
     楼主| 发表于 2020-2-6 15:04 | 只看该作者
    在“Differential Pair”和“Relative Propagation Delay”里面,选中Xnet网络,“Delete”是不可用的;在“Model Assignment”里面试过“Clear All Model Assignments”也清除不了。
    6 i/ Q' ~7 Y% z( V

    Allegro_CM1.png (118.79 KB, 下载次数: 11)

    Allegro_CM1.png

    Signal_MA.png (37.94 KB, 下载次数: 10)

    Signal_MA.png
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    3#
     楼主| 发表于 2020-2-6 17:24 | 只看该作者
    目前知道问题是由于我在Orcad中打开Constraint Manager之后,再生成网表,导入PCB后就会出现一堆Xnet网络。9 q4 E) o1 w9 g6 Y8 v! a

    6 ~9 \* q' K' U- ^3 M- ~. Y; _我新建一个DSN文件,在不打开Constraint Manager的情况下生成的网表,再导入到Allegro 新的PCB文件,这样PCB中就没有那些Xnet网络。( {; N' x( V8 g' g3 ?
    6 S! j" _$ F  @1 A
    新的网表导入到原来有Xnet的PCB上,却更新不了,那些Xnet还是没有去掉,期待得到大家的解答,谢谢!
  • TA的每日心情
    开心
    2024-2-21 15:59
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    [LV.8]以坛为家I

    4#
    发表于 2020-2-6 19:00 | 只看该作者
    OrCAD导出网表时,勾选下图的选项:
    " a6 C! ~5 i/ I+ `) D* N. U* u1 R6 X

    点评

    我的图图呢  详情 回复 发表于 2024-1-3 20:37
    为啥看不见啊!能再发下图吗  详情 回复 发表于 2022-8-16 15:10
    啥选项呀?  详情 回复 发表于 2022-5-31 17:13
    看不到内容  详情 回复 发表于 2022-3-3 20:34
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    2020-6-23 15:00
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    [LV.5]常住居民I

    6#
     楼主| 发表于 2020-2-8 15:27 | 只看该作者
    我原来在用16.6的时候,Tools菜单下是没有Constraint Manager这一栏的,17.2版本新增了这个功能,但是可能有BUG吧,不知道17.4的版本在原理图下点开CM后会不会也有生成Xnet的情况。原来想试用一下新的功能,但如果有问题就不能再用了,只能在后续做图时小心一点,不要再在原理图进入Constraint Manager。
    0 T; K# U9 |  r3 Z) R& G
    " c; V" Z6 D* h, y$ U" I' ?; N0 t6 ^

    Orcad-CM.png (89.49 KB, 下载次数: 12)

    Orcad-CM.png

    点评

    我在楼下回复你解决方案了。  详情 回复 发表于 2022-1-24 17:31
    17.4同样的问题  详情 回复 发表于 2021-12-17 17:10

    该用户从未签到

    7#
    发表于 2021-12-2 17:11 | 只看该作者
    您好这个问题解决了吗,我也遇到了一样的问题,好奇怪4 e8 v* ~) Q  I2 o* j2 e
  • TA的每日心情
    奋斗
    2021-11-30 15:19
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    [LV.5]常住居民I

    9#
    发表于 2021-12-17 17:10 | 只看该作者
    lc_0755 发表于 2020-2-8 15:27
    / I/ b1 h/ B; ^% M我原来在用16.6的时候,Tools菜单下是没有Constraint Manager这一栏的,17.2版本新增了这个功能,但是可能 ...
    3 y4 g6 x1 `# }+ A" }
    17.4同样的问题
    1 M5 V  c7 H: z9 Q: _. c9 Z

    该用户从未签到

    12#
    发表于 2022-3-3 09:49 | 只看该作者
    同问,貌似变成了xnet,分配差分对也不行了

    点评

    差分对分配更方便了,xnet前后都一起帮你分配,在logic——assign differential pair菜单下分配  发表于 2022-10-3 07:24
  • TA的每日心情
    郁闷
    2024-5-21 15:46
  • 签到天数: 158 天

    [LV.7]常住居民III

    13#
    发表于 2022-3-3 20:34 | 只看该作者
    dzkcool 发表于 2020-2-6 19:00
    7 Q1 d7 d" P9 H4 d( Y$ N. l( IOrCAD导出网表时,勾选下图的选项:
    ( m: b  z9 S* ]4 J/ A
    看不到内容

    点评

    学习一下  详情 回复 发表于 2022-5-31 17:10

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    14#
    发表于 2022-5-31 17:10 | 只看该作者
    9990 发表于 2022-3-3 20:342 p+ [1 z& \3 z* k5 O
    看不到内容
    . J3 J# c' N- f/ j
    学习一下   
    " Q6 _+ \5 Q9 U* Q- N% C

    该用户从未签到

    15#
    发表于 2022-5-31 17:13 | 只看该作者
    dzkcool 发表于 2020-2-6 19:00
    ' O% Z' ^# K2 V* L2 Y) t! }4 LOrCAD导出网表时,勾选下图的选项:
    3 m7 C  w" J$ M5 _3 Q: z0 r
    啥选项呀?0 x- @; I% u( p& b/ l& N4 \
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