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[仿真讨论] 信号完整性设计时间管理

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1#
发表于 2020-1-19 10:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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很多企业在做PCB的时候都会经历长时间反复调试,找到问题,然后再次打板的过程,其实这里面很多问题完全可以通过前期设计就规避掉,提前规避风险,避免出现问题是成本最低的一种方式。
PCB上的各种现象,有其内在的规律,信号完整性就是关于这些规律的一门知识。如果前期就知道“这里这样做一定会出现问题”,那完全没必要在调试阶段解决。很多企业急于打板调试,不重视前期设计,意愿是好的,都想尽量快的完成项目。但往往后期不得不花大量的时间来调试。
不出问题或尽量少出问题是最好的方式,一旦出了问题,可能就需要好几倍的时间才能解决,得不偿失。而且打补丁式的解决方法有时非常困难。因此前期稍微花点时间注意一下可能出现的问题是非常值得的。设计过程中只要注意一点PCB设计技巧,完全可以大幅度的减小PCB设计风险。
为什么要把时间浪费在后期调试,而不再前期规避呢?后期调试时一旦出问题,那是相当的折磨人,往往搞得工程师精疲力尽。
一贯理念:前期尽可能的规避风险,不要把问题都留给调试。尽管信号完整性设计不能100%消除风险,但前期就消除99%风险和对风险不加控制完全是两个概念。
/ V" j- l; B6 l/ F' F

该用户从未签到

2#
发表于 2020-1-19 18:40 | 只看该作者
工程师时间管理是很重要的

该用户从未签到

3#
发表于 2020-2-20 16:52 | 只看该作者
说的有点意思
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