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pads logic 2005 如何做ERC检查?

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1#
发表于 2008-3-19 16:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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问题如标题,padr怎么进行ERC检查??像protel那样,( ^& }5 Z; L4 f) x/ i$ {
怎么确保原理图设计正确??期待解答

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tianhao + 3

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2#
 楼主| 发表于 2008-3-27 12:55 | 只看该作者
我每次上来都看看我发的这个帖子,怎么没人回答??

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3#
发表于 2008-3-27 14:00 | 只看该作者
我也等着有人来回答这个问题

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4#
发表于 2008-4-2 19:54 | 只看该作者
原帖由 droden 于 2008-3-19 16:26 发表 ) w7 F' a. g" g# n, o7 ^8 c/ S
问题如标题,padr怎么进行ERC检查??像PROTEL那样,' X# c3 V6 h) i5 l9 v# y/ J
怎么确保原理图设计正确??期待解答

$ ?5 L! K1 R3 P# f& U5 O! E6 K1 m3 [' D; b) ?; e
以创建netlist的形式,如果有错误会有报错信息。
5 Z) i; i+ H; I3 x* w其实PADS可以实现ERC的方法很多9 v& H  f3 j0 y0 v, L
1.creat netlist
8 K+ R2 @, x- R# Z2.export-import0 j" F5 a* B9 D& G$ `
3.report输出bom可以查看

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5#
发表于 2008-4-2 21:19 | 只看该作者
我以前刚接触到PADS 的时候也有同样的问题,( 之前用的DXP), 不过熟悉了后根本不去考虑这个问题, 画完SCH后产生ECO导如PCB.

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6#
发表于 2008-4-4 14:02 | 只看该作者
设置好直接倒就行吧,基本不用Logic,仿真功能比较弱,建议用其他的吧。

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7#
发表于 2008-4-15 20:58 | 只看该作者
同步PCB的时候也会检查的

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8#
发表于 2008-4-16 11:17 | 只看该作者
画完SCH后产生ECO导如PCB 有问题会有txt文档提醒的

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tianhao + 2

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9#
发表于 2008-9-2 15:50 | 只看该作者
又学了一招,谢谢
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