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如何设计原理图

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1#
发表于 2009-9-25 09:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
在设计原理图中应该考虑哪些方面?* w( c+ |: p$ B+ |' K. ?
比如设计一个时钟电路 或数字中频电路
$ F' O  e/ E! \1 i正在设计一个时钟电路,但不知从何下手~~, ^! u. Y! m0 Y$ p
望大家给点意见  谢谢~~
# j  I+ K0 c  I3 ~( W希望有经验的兄弟姐妹多发表看法 谢谢

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2#
 楼主| 发表于 2009-9-26 21:29 | 只看该作者

如何设计原理图

没人发表意见

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3#
发表于 2009-10-1 21:05 | 只看该作者

如何设计原理图

你这个问题太难回答了

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4#
 楼主| 发表于 2009-10-1 21:28 | 只看该作者

如何设计原理图

真的是不懂呀~~请教
( c) B; ?4 I. K4 u% D其实我只想知道大家是怎么去做的~~~
( g( K8 z/ b! Z+ Y5 d9 k0 ~9 C2 o# r9 d% D
应该注意些什么地方  比如阻抗匹配问题   还有去耦问题 只需根据芯片datasheet就ok么?

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5#
发表于 2009-10-4 16:52 | 只看该作者

如何设计原理图

基本上,目前的电路设计都是按规格书的要求,( w5 j4 X! S, s: \+ ^% ~
但是规格书上的值都一些厂家的建议值,
6 V% r) z. I& b面对具体的设计问题还需要适当的调整,- b9 E9 I; V& a
至于你所的阻抗匹配,和去耦问题,我可以做入下解释:9 {6 i% n  [; I7 \$ P
阻抗匹配的母的:是使信号顺利传输不反射,+ i8 w$ Y4 H* J, B) n
一般设计在传输线的终止处接上与传输线阻抗相等的匹配网络。
8 e9 l5 k0 C7 x& h, M. K2 @0 a50欧姆,75欧姆
! M+ m+ n2 I$ O: U9 K, ^  _8 X
: c, k  ]% n( u; I/ ]2 x1 H去耦,一般要求不是很严格,
7 V* U* ?$ D( D6 u, ]C=1/F, 10M接0.1uF,100M接0.01uF
) g) p$ v" D1 k; G( z: c6 l3 X当然如果你要更加精确的,就利用阻抗计算公式,用最大阻抗去计算电容值。

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6#
 楼主| 发表于 2009-10-5 18:18 | 只看该作者

如何设计原理图

说的好 学习学习 谢谢

该用户从未签到

7#
发表于 2010-5-22 14:38 | 只看该作者

如何设计原理图

回复 5# xiaodun123
% }( _* G) Q2 o( y- [) x
2 R; B$ e% A) X3 f' \& T1 K0 ]4 W* e. \: n" c
    学习了,谢谢!这个问题也是我想知道的。
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