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刚学allegro,问几个比较低能的问题.....以后连载

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1#
发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !
1 r, n0 f( D8 L  ]/ B" }$ e1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。
9 O5 j( n- v1 x9 B3 ^. d6 \+ o( G2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。
& u1 t  T5 M% [3.今天学习Allegro遇到的几个问题:9 E! D: r3 k+ l" d6 s4 t$ X
   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:* q# V0 v' Q3 s
. W2 _1 k' ~" Z5 I5 M5 X/ _" T
2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?/ @" t4 [: k* J8 B: p& J+ O% I3 x
  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?* C& n" U9 V  F3 K* W( [/ A/ k( W
3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:
3 F6 h1 f, I- i6 Q# j# y) H    LISTING: 1 element(s)1 c  o0 ^3 t  H; I; A

8 N. C8 f4 \6 t* {$ E       < COMPONENT INSTANCE >       ! ^1 M; g2 ?# D& H" J  q
2 ~& r& u, P# a/ S% I) K
  Reference Designator: U7
- g# `: Y- N3 j; |! g  C: {  Package Symbol:       PBGA400. l1 e+ J4 |' Z
' s( m8 t5 t3 H
  Component Class:      DISCRETE8 k/ _7 x+ {8 F$ f
  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB# ~( e9 E) Y1 P9 n  I, P; m
    Value:              KSZ9692PB9 I# p, L+ W- p4 x
, q2 W- e! q. w
  Placement Status:     PLACED# {. K' s+ s. X7 M; Z( Y; f3 r
    origin-xy:    (5150.000 4512.500)
5 x& f# J5 s. b$ o+ J) Y    rotation:  0.000  degrees, x4 l) C1 R) Y# b. h+ [7 B( K
    not_mirrored+ A& Y3 S/ w$ H+ q9 a' w
) r+ B: y- e/ q; }5 S- e
  Function(s):4 T6 N* R$ x  c$ e+ _
    Designator: F11, E7 ~' r* ~* ^! z. z
    Type:       TYPE43 T# Y" t/ A* }9 i
    Pin(s):     C10, E10, A7, A6, A8...
' B5 m2 I& N7 L* b9 f9 P1 v' W+ A& @  r
    Designator: F10# [  H) L! |) U9 @$ d, a
    Type:       TYPE3
- ~, A' ^: p" p" Y: x% M+ x    Pin(s):     V16, Y18, T16, U17, V18...
! ~! d2 `+ ^# ]/ _
% f+ s4 Z7 l  M; m0 y3 z    Designator: F9
0 T# p. }  o( v8 [7 F& ~2 Y    Type:       TYPE2% ?) K9 t- v" ^& b
    Pin(s):     H10, H11, H7, H8, H9...
# ?4 h  b5 K3 [) x6 B1 N5 {/ I) O
' K6 b1 N% V- V# P3 n3 w    Designator: F8
+ |6 E0 x: r; A+ V. }. Q6 _    Type:       TYPE1
8 \& ^1 K8 I# a/ ?" {0 e    Pin(s):     H19, H18, H17, P20, M17...! C9 _2 ^/ u# v$ j

9 Q, V( S' l1 W' ?7 b  Properties attached to component instance3 t4 j) ]$ u, g% H0 ]
    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB
6 Q3 o- {  i4 A6 n! w1 a2 k( F3 o
$ g1 R1 _6 B* m2 t, ]  Properties attached to component definition, V0 J, U6 w: \0 T( g
    VALUE             = KSZ9692PB
; Y' w% s% ^4 g6 R
3 f9 U; R" }2 z" w. E请问这个Function(S)和SIGNAL_MODEL是指的什么属性?- i( W* f  ]' m) J/ U, `/ t' u  D
先就这么多了。希望哪位兄弟能尽快帮我解决一下。

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2#
 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:0 f1 E& C0 ^8 F, x( l# j4 L. `- N
我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?
2 v7 C- E, G' A/ i& g5 y如附件:
! ~( Q% v% ^7 J

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3#
发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,& p) [. z! \* u) y; l2 c
  传个给我好吗!  @ 谢谢啊!@  
$ I1 t2 H% `) ?6 y
( [7 K. m8 e. G6 Z' Z0 Y我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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4#
 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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5#
发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng
$ U  D+ a8 T) c$ H7 v9 z: w
4 i& X  `( F$ x. G8 h/ i5 A  c! D2 y9 K  e! O
开防焊是不是为了用此via做测试点啊?

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6#
发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下( I& b# z4 Z% N: d
论坛里有比较好的教程的

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7#
发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。# h% p0 l1 b+ e+ q4 F9 c
只能说:你多加油吧,多加班吧!!!

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8#
 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?( K9 I% i: j* S5 e$ c+ r0 f

0 O3 A, R. B( b/ h- G2 [. I5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...
. Q9 x0 P. G8 e" w. V; r2 ?前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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9#
 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6#+ I5 e- v7 ]& S
0 `. @8 z& g6 Q
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
; M) s* p) y* |论坛里有比较好的教程的.
7 R' Q8 I" ^# S% N( c, r! L
7 {, f3 f& b. l这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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10#
发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑
6 a* y. J: j% A7 J: x
* ^) U( k. k' f! ~: _6 l  K8# caiyongsheng - g) c, l" u% q9 i5 r6 L- J
+ j, h4 k% L8 j2 |3 ?
過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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11#
 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
" ?7 d$ o9 ]8 g9 h/ c; }No_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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