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两片DDR PCB T形等长走线的疑问?

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  • TA的每日心情
    开心
    2023-5-6 15:09
  • 签到天数: 1 天

    [LV.1]初来乍到

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    1#
    发表于 2019-10-22 21:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    x
    最近在学习DDR高速PCB设计,但是对于DDR2的T形走线不太明白,请给各位前辈指点一下:$ w) _+ [/ [9 E& U
    1. 第一个网络走线中的L1和L2需要等长吗?
    " A0 T; M! m4 N0 o. w, [% d9 n2.等长蛇形走线一定要在L3和L6处吗?还是在任意一处走蛇形线都可以?2 j  _4 E6 o5 o4 _" K9 R% c* A+ X' D
    - `- Y4 W$ Q1 D6 _: i
    多谢!!3 M  V' O6 Q5 J

    4 P; d# i" o% M( Z
    1 `, W+ m& M/ u* m

    ddr.png (13.27 KB, 下载次数: 7)

    ddr.png
  • TA的每日心情
    开心
    2023-5-6 15:09
  • 签到天数: 1 天

    [LV.1]初来乍到

    推荐
     楼主| 发表于 2019-10-23 19:40 | 只看该作者
    多谢几位解答,因为没有搞过,所以有些基本的东西都不了解,
    . Z- L! X7 h/ q! M& ~. u+ _按照几位说法,就是先保证L1=L2,  L3=L4,然后再调整L3和L6,使总长度相等,是这样吧
  • TA的每日心情
    开心
    2019-11-28 15:00
  • 签到天数: 7 天

    [LV.3]偶尔看看II

    2#
    发表于 2019-10-22 23:20 | 只看该作者
    一般是保证到负载总长度相等的前提下,做到分支*(红色)等长即可。要求严格的要做到分别等长,即控制器到DDR的主干(绿色)等长,然后是分支(红色)等长。
  • TA的每日心情
    开心
    2020-4-13 15:11
  • 签到天数: 28 天

    [LV.4]偶尔看看III

    3#
    发表于 2019-10-23 14:02 | 只看该作者
    L1=L2,L4=L5,L3=L6。

    该用户从未签到

    4#
    发表于 2019-10-23 15:11 | 只看该作者
    本帖最后由 超級狗 于 2019-11-6 00:01 编辑
    % J: l5 V! k7 p: K+ ~3 u- A  J$ H* `
    這個問題無關技術,蛇線的目的是要調整走線等長。: T6 X# p! i0 d5 L" j! ^

    - I! ^8 [( q$ n( r2 I對 T 型分支架構來說。
    / \9 D2 c# z" z( u- T+ Y* o
    • 放在 L3 或 L6,調整不到分支部份 L1 和 L2 或 L4 和 L5 的等長。
    • 放在  L1 和 L2 或 L4 和 L5,調整不到共線部份  L3 和 L6 的等長。
      6 `2 N4 u! ^$ T: n( \9 L* b
    8 H  o  p5 ~1 H$ C4 N5 v
    所以你想要哪段走線等長,就放在哪一段!) P* y; X8 I7 x7 X% b( l
    + Y# O( F  z  |, _

    : N, V2 F0 I! l3 O- U4 Q2 w
    ! [& Y% h9 |  G+ i8 S0 C5 j
  • TA的每日心情
    开心
    2019-11-19 15:00
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
    发表于 2019-10-24 09:39 | 只看该作者
    L1+L3=L2+L3=L4+L6=L5+L6

    该用户从未签到

    7#
    发表于 2019-11-5 20:01 | 只看该作者
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