本站微信 收藏本站 设为首页
 找回密码
 注册
关于网站域名变更的通知
EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 基于FPGA自主控制浮点加减控制器设计
返回列表 发新帖
查看: 293|回复: 5
打印 上一主题 下一主题

基于FPGA自主控制浮点加减控制器设计

[复制链接]
A-Lin

该用户从未签到
跳转到指定楼层
1#
发表于 2019-8-26 07:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录！

您需要 登录 才可以下载或查看，没有帐号？注册

x
本帖最后由 A-Lin 于 2019-8-26 10:25 编辑
# E8 E9 |" l- |& Z
* Q2 k; ~* I4 {' R
基于FPGA自主控制浮点加减控制器设计
/ B  T: w3 M( [( q: S: ~" m: T
提出了一种基于采用FPGA并行操作电路硬连接的浮点数加/减运算控制电路及其时序控制方法;该控制器在接收到操作数类型与参与运算的操作数后,在内部时序脉冲作用下.可以自主完成操作数的配置以及浮点数加/减法运算的功能,运算结果传输到系统数据总线;论述了该控制器的电路构成和基本原理,分析操作数类型与操作数在内部时序脉冲作用下的执行过程,应用Verilog HDL语言实现相关硬件的构建和连接。
游客，如果您要查看本帖隐藏内容请回复

$ R2 `. W/ _1 i! v4 ?8 t

下载资料威望不够？点击查看获取威望的N种方法>>
回复

举报

EDA365微信号及QQ群号！
fanichicl

该用户从未签到
3#
发表于 2019-8-26 18:34 | 只看该作者
看看你的方案

下载资料威望不够？点击查看获取威望的N种方法>>
回复 支持 反对

举报

雷北城

该用户从未签到
5#
发表于 2022-7-8 14:47 | 只看该作者
基于FPGA自主控制浮点加减控制器设计

下载资料威望不够？点击查看获取威望的N种方法>>
回复 支持 反对

举报

瞪郜望源_21
  • TA的每日心情
    开心
    2025-10-2 15:42

    • 签到天数: 1185 天

    [LV.10]以坛为家III
    6#
    发表于 2022-7-8 15:25 | 只看该作者
    不错，好东西，很是专业和深度，学习下

    下载资料威望不够？点击查看获取威望的N种方法>>
    回复 支持 反对

    举报

    返回列表 发新帖
    高级模式
    B Color Image Link Quote Code Smilies
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-10-6 21:02 , Processed in 0.171875 second(s), 26 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表