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FPGA ------- 2级D 触发器

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发表于 2019-7-5 13:18 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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D触发器! o+ e. r: A2 D: G, H, h- k
在时钟上升沿,D输入0,Q输出1
  M4 I  |2 v1 f) J$ D8 p' k在时钟上升沿,D输入1,Q输出0* a. M) L- f% s4 H8 Y3 `$ i
输出只在上升沿发生变化。
" g' t1 f6 N+ A! n/ p4 G5 q一般的;
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该用户从未签到

3#
发表于 2022-5-19 09:57 | 只看该作者

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4#
发表于 2022-5-20 08:18 | 只看该作者
看看理论知识
  • TA的每日心情
    开心
    2025-10-2 15:42
  • 签到天数: 1185 天

    [LV.10]以坛为家III

    5#
    发表于 2022-5-20 15:05 | 只看该作者
    不错不错,写的很是专业和深度,学习下
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