基于FPGA的级联结构FFT处理器的优化设计

A-Lin

- a7 {) v+ s: {5 M# t" E( J7 A) v

基于FPGA的级联结构FFT处理器的优化设计

, X5 E; c( @8 l& P/ L2 b# }% c% ]/ C
. O- w# i9 n7 I' I

5 s& D( _+ g7 u' _+ l% f) l3 D
0 A, C' _5 b  o4 ?' H: a引 言 数字信号处理主要研究采用数字序列或符号序列表示信号，并用数字计算方法对这些序列进行处理，以 便把信号变换成符合某种需要的形式。在现代数字 信号处理中，最常用的变换方法就是离散傅里叶变 换(DFT)，然而，它的计算量较大。运算时间长，在某种程度上限制了它的使用范围。快速傅里叶变换 (FFT)的提出使DFT的实现变得接近实 时，DFT的应用领域也得以迅速拓展。它在图像处理、语音分 析、雷达、声纳、地震、通信系统、遥感遥测、地质勘探、航空航天、生物医学等众多领域都获得极 其广泛的应用。随着FPGA技术 的高速发展以及EDA技术的成熟，采用FPGA芯片实现FFT已经显示出 巨大的潜力。 目前用FPGA实现的FFT处理器结构大 致分为四种：递归结构、级联结构、并行结 构和阵列结构。递归 结构只利用一个碟形运算单元对数据进行规律的循环计算，使用硬件资源较少，但运算时间较长。级联 结构每一级均采用一个独立的碟形运算单 元来处理，相对递归结构速度上有所提高，不足之处是增加 了延时用的缓冲存储器使用量。并行结构对一级中的蝶形单元并行实现，阵列结构是将每一级的蝶形运 算 单元全部并行实现，这两种结构有很高的运算速度，但消耗的资源过大，一般不采用。为了提高运 算速度，特别是为了适应多批数据处理，一般采用级联结构实现 FFT处理器。
7 ^+ n/ ~+ U! w) N9 X" r

游客，如果您要查看本帖隐藏内容请回复

yxlk

很实用的东东，谢谢分享

雷北城

基于FPGA的级联结构FFT处理器的优化设计

putongren

是好东西，谢谢