找回密码
 注册
关于网站域名变更的通知
查看: 391|回复: 2
打印 上一主题 下一主题

低成本实现FPGA中的动态相位调整

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2019-7-1 16:10 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
FPGA中,动态相位调整(DPA)主要是实现LVDS接口接收时对时钟和数据通道的相位补偿,以达到正确接收的目的。ALTERA的高端FPGA,如STRATIX(r) 系列中自带有DPA电路,但低端的FPGA,如CYCLONE(r)系列中是没有的。下面介绍如何在低端FPGA中实现这个DPA的功能。
1 {, K( P5 S' u) w# O& V9 M) x3 P: u( ]) J/ z0 H; a- m
3 \; K6 T8 j/ f3 i  O1 I5 b) f: m6 S( F
实现架构
- v$ z# ^; I7 v* K& j& Z8 `
8 ^  q9 Q( G- V" `/ V+ A

% L4 j" R- b/ m8 i
游客,如果您要查看本帖隐藏内容请回复
/ J5 a, b; {6 G
9 |1 u0 S" O3 ^9 T- _$ L
0 C  Z6 m& k* P& a0 ]9 w

: i, K8 K5 i& T- L3 q
8 S; `8 p/ _, D0 e/ J7 g  l" b' `
6 R/ N5 W: H% R3 V4 ^6 l
. x# N3 [9 }% H: a3 {' m; M3 T3 \
% k4 B% z5 @# \3 A* l! t; f2 S. v

该用户从未签到

2#
发表于 2019-7-1 16:33 | 只看该作者
发帖是心得 回帖是美德

该用户从未签到

3#
发表于 2022-6-21 15:11 | 只看该作者
低成本实现FPGA中的动态相位调整
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-10-6 19:08 , Processed in 0.171875 second(s), 27 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表