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转——菜鸟之开发环境的搭建

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发表于 2019-4-19 14:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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转——菜鸟之开发环境的搭建

4 z  n) Q! ^% B( T- R' u) [最近一直在纠结开发环境的搭建。由于本人的系统是32位的,而QUARTUS 最新版本只支持64位的,所以我注定与最新版本无缘咯。再加上电脑的很多软件装起来很麻烦所以就选择了13.0的版本的QUARTUS,安装包是官网上下的,至于和谐的事嘛,百度一下你就知道咯。仅供学习。, c' @; ?' M( ~; P0 l5 Y/ O: X
             然后就是安装 Altera SoC 嵌入式设计套装(Altera SoC EmbeddedDesign Suite),至于安装过程网上也有教程。这里就不说了。由于之前安装过QUARTUS然后就不用再和谐了,软件可以顺利使用。安装包嘛官网上也有2 i( p: W: n6 w) @) U! l
            再然后就是 在 PC 上安装 上安装 Linux系统了。由于本人之前没怎么接触过,所以安装之路相当坎坷。最终本人选择的是安装虚拟机然后再安装系统,这样的好处当然是简单方便了。。最重要操作步骤挺简单的。LINUX希望别太难。真心感觉SOC涉及面太广了比以前使用FPGA难太多,感觉自己有太多需要学的。好了截张图看看这几天忙活的软件安装。
6 w( Z& n3 Q5 S2 x! ]              . L+ q/ }  }) S' |/ d  M
然后就是学习一下为用户手册上的东西,大家一起学习一下
/ a/ ]. B( s5 l- U: kSoC FPGA 设计流程
$ g. V* U+ h, Z' N        基于SoC 的FPGA 嵌入式系统硬件与软件的开发流程如图 2-1 所示。首先要基于Qsys规划系统需要的外设,包括HPS 与FPGA 各自的接口。HPS 外设只需要根据DE1-SoC 硬件属性进行设定即可,FPGA 外设依旧是通过IP 模块的方式添加。然后建立各个模块间的连接(时钟,复位,总线),最后产生出硬件与软件开发各自所需的档案。
% g, M2 H; [3 X: U& N4 U
7 |% R9 \  E* f% u0 w4 H* M             5 J  e5 c" F% m0 u3 a# I/ E0 B
        至于详细的流程大家可以参考5_DE1-SoC_Training materials资料。由于文件太大无法上传30M的东西本人权限有限不能上传,大家可以论坛里找一下。。。我就是在论坛下滴
7 A+ V% r9 @4 W1 i0 e* H

该用户从未签到

2#
发表于 2019-4-19 17:38 | 只看该作者
哈哈,这个好
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