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有关FPGA的配置的问题

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发表于 2019-4-4 14:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请教大神,
7 \' n7 B" G# q, O/ X如图一中,unused pin是配置为“三态输入输入”,还是“三态输入加弱上拉”。) @0 T$ c+ t9 M
图二中,为什么要把这些dual_purpose_pin设置为“use as regular IO”.他们可是专用的引脚的啊,非常感谢!
/ V. B8 V# d! [* k9 r7 l) F- }8 \5 v: U

. ~. w6 z6 B4 E! Q. l
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