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[HyperLynx] 仿真报错求解

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  • TA的每日心情
    奋斗
    2020-7-22 15:05
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    [LV.2]偶尔看看I

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    1#
    发表于 2018-10-18 12:42 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    Hyperlnyx中仿真,U1芯片为XCZU11EG-2FFVC1760E,9 A, l0 ~0 c: H& ]. |7 R5 J
    使用IBIS模型为zynquplus.ibs9 r2 Y" A- e$ e  z- }9 B7 ^* I

    " A; g/ K9 r) [# ^[IBIS ver]       5.1
    0 ~! U7 p! ]. m7 l& `' U[File name]      zynquplus.ibs- A1 ~3 q# X2 `3 ?: O
    [File Rev]       1.12$ E4 n6 z" K; [! `5 ~* e) N! q
    [Date]           22-MARCH-2018
    + \' l2 `$ g  @# l[Source]         Derived from spice models, rev1.0, using' o1 o% @; O' ?& _) E( s7 C
                     hspice 2014.09-SP1-2
    1 E  N% o: S; Y6 X$ y: `" \[Notes]          Xilinx IBIS file for Zynq UltraScale Plus I/O standards.
    * v6 w# X) |# y                 All models are preliminary.
    1 y  K$ k- D- N6 r! H( T  c                 The version of IBISCHK used is ibischk5 V6.0.1.( s7 b; c- B% p7 V0 u
    |; W( V" F, Z, E5 R2 q" f
    [Disclaimer]     The data in this file is derived from SPICE simulations using& ?7 a. ~9 c& `: X- q9 g
                     modeling information extracted from the target process. While* d% y! ]4 j1 h: R
                     a great deal of care has been taken to provide information
    : _/ K% C# g4 O( X* H                 that is accurate, this model is considered preliminary as it
    ; n- I4 j# {9 w2 p$ O: M# y                 has not been verified by actual silicon measurement. Treat the" b( l0 s, b$ M2 k$ Z, l$ K9 ]
                     data in this model as preliminary until actual silicon6 \% H% S. S* s3 d8 r1 ?( q2 J
                     verification is peRFormed.
    - [8 u. V  P0 h- F, y|
    9 {2 \- S3 `5 d8 A  D3 M* ][Copyright]      Copyright 2016, Xilinx Inc., All rights reserved& E( ?; g1 c- s$ f# A+ ?0 J

    $ D6 _% @& N$ G7 e  [
    ( N, i/ H4 D: v2 A% _4 }8 r仿真的时候报错如图,请问各位朋友这个该怎么解决啊?  z9 N5 G7 q( k" Z! n
    8 p  L# h8 y4 p4 d  J

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