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千兆以太网 TCP, UDP协议, FPGA实现

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发表于 2018-8-29 15:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 alexwang 于 2018-9-6 17:40 编辑 4 A/ U$ O" `8 V& R1 s7 L  d
% H' @( o3 {5 B9 a* R5 P9 v/ d% `
转——千兆以太网 TCP, UDP协议, FPGA实现
       目前TCP协议大多由cpu跑代码实现, 这次用FPGA的纯逻辑实现 , System Verilog编写,下面给大家粗略讲一下我的实现方法,下面是工程的示意图.
, [% y& c8 m* v! }
, ^5 z/ m) v+ W
       这个工程由几部分组成, 外部使用了88e1111千兆以太网phy。FPGA内部有几个大的模块,
       顶层模块:
  
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    发表于 2019-11-7 08:29 | 只看该作者
    厉害呀,                                          
    . m" \- S) J$ [% [' \) z) h9 r

    该用户从未签到

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    发表于 2018-9-5 09:46 | 只看该作者
    做出来的效果如何?关键是对layout的要求难度是提高了,还是降低了。
    9 h* `5 w: z2 p; y. \" ~频率越高,layout的难度越大。1 V+ ], j: Z+ u, H( M
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    [LV.5]常住居民I

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    发表于 2019-12-5 20:37 | 只看该作者
    谢谢楼主分享,正有这方面的考虑呢

    该用户从未签到

    11#
    发表于 2018-12-4 16:31 | 只看该作者
    谢谢楼主,楼主好人

    该用户从未签到

    17#
    发表于 2019-10-6 11:59 | 只看该作者
    正要学习

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