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[HyperLynx] hyperlynx9.4.1。timing module 时序模型

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1#
发表于 2018-6-6 11:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我用hyperlynx9.4.1仿真DDR4,发现在设置timing module时没有默认的.V文件,后网上看论坛帖发现,原来安装路径下有。现贴出以方便新来的。! a& b8 t$ }4 `" a+ `
我的安装路径是:d:\mentorGraphics\9.4.1HL\SDD_HOME\hyperlynx64\Libs
9 U# o8 ?) @/ y; j另还有个问题。9.4.1安装到win10后,PCB导入时没有brd的格式。但同样安装到win7下就正常,估计是win10的兼容性还不够好。. I3 c+ q3 z! D# Z
混点积分。。。。6 X8 X4 G/ X- L( u7 d  S- i) T

该用户从未签到

3#
发表于 2018-6-14 08:45 | 只看该作者
您好!方便把你的DDR4的timing module的.V文件的问价共享一份吗,谢谢,

该用户从未签到

4#
发表于 2018-6-14 09:15 | 只看该作者
同求DDR4的timing module文件,谢谢!
  • TA的每日心情
    擦汗
    2019-11-15 15:00
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    [LV.1]初来乍到

    5#
    发表于 2018-6-19 13:31 | 只看该作者
    00000000000000
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    [LV.9]以坛为家II

    6#
    发表于 2018-6-20 08:24 | 只看该作者
    win10?还是win7吧

    该用户从未签到

    7#
    发表于 2018-10-15 18:14 | 只看该作者
    学习学习,静待大神! ^$ ?3 |3 O3 m

    ; |; g: Y6 u! E% a
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    8#
    发表于 2023-2-6 16:43 | 只看该作者
    仿真的时候也可以在向导里面生成
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