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485通信隔离电路设计通信不了问题请教

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1#
发表于 2017-12-19 15:02 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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下图是一个带隔离的485通信电路,调试的时候发现这样设计通讯不了。调试程序是用数据回环测试调试的,也就是通过USB转485给板子发什么数据就收到什么数据并用串口助手打印出来,帮忙分析下问题出在哪里?谢谢!. u( d0 R: v1 ]! N' e/ N

. y1 w0 q( S* F, p

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2#
发表于 2017-12-19 20:13 | 只看该作者
485的方向和发送的网络标号一样了,原理上没啥问题

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3#
发表于 2017-12-20 10:19 | 只看该作者
看下光耦的规格书  你串的1K电阻应该大了   485—TX加个上拉试试

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4#
发表于 2017-12-20 19:14 | 只看该作者
1、光耦三级管输出要加上拉
* _9 M, q: e' g; q: k3 G2、光耦二极管测串的电阻有点大,根据传输比计算下合适的阻值

点评

请教下,怎么根据传输比计算阻值  详情 回复 发表于 2017-12-27 09:01

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5#
发表于 2017-12-21 11:50 | 只看该作者
分析:2 Q$ t  y9 d2 @- Y0 H3 \) e
1、485EN接了上拉电阻4.7K,那么当MCUTX为0的时候485EN为高电平,485芯片使能发送;当MCUTX为1的时候,485EN为低电平,485芯片使能接收,关闭发送。这有问题吧。
& v) x* g8 v% C9 B. Z- q! Q. S2、MCUTX不发送的时候,485EN好像是在上拉状态,那么接收使能是关闭的啊
9 k- s; v+ E% c; ~+ v# `

点评

至于上电en是高低,上电初始化后tx都已经设置好的  详情 回复 发表于 2017-12-23 10:29
当发送0时,en管教为高,发送的0表征在AB线上。当发送1时,en管脚拉低,AB线上呈高阻态,由于A上拉,B下拉,AB线上大于0.2V所以AB为高电平。这是自收发电路原理  详情 回复 发表于 2017-12-23 10:25

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7#
 楼主| 发表于 2017-12-23 10:25 | 只看该作者
AD9_PCB 发表于 2017-12-21 11:50& `8 k6 L5 _& Y' @+ U; M
分析:
% H1 i! x1 w/ ] 1、485EN接了上拉电阻4.7K,那么当MCUTX为0的时候485EN为高电平,485芯片使能发送;当MCUTX为1的时 ...
7 n, S- J/ M% F2 a
当发送0时,en管教为高,发送的0表征在AB线上。当发送1时,en管脚拉低,AB线上呈高阻态,由于A上拉,B下拉,AB线上大于0.2V所以AB为高电平。这是自收发电路原理
+ o  s+ f( I4 x% H: ^

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8#
 楼主| 发表于 2017-12-23 10:29 | 只看该作者
AD9_PCB 发表于 2017-12-21 11:503 G/ x! D1 L; A, B* n3 U3 _1 J! H
分析:
+ \6 a$ ]$ ~! g 1、485EN接了上拉电阻4.7K,那么当MCUTX为0的时候485EN为高电平,485芯片使能发送;当MCUTX为1的时 ...
, I9 z6 k* M$ p3 r6 N1 B6 q. O
至于上电en是高低,上电初始化后tx都已经设置好的

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10#
 楼主| 发表于 2017-12-27 09:01 | 只看该作者
Leeone 发表于 2017-12-20 19:14
" o7 ~  s; {2 {. @6 c' {1、光耦三级管输出要加上拉& {/ F9 F7 M$ U$ N- Z  o8 C: V8 _( I6 F
2、光耦二极管测串的电阻有点大,根据传输比计算下合适的阻值
, L% P5 Z0 Y/ F$ V
请教下,怎么根据传输比计算阻值
$ ?0 F8 Z. s6 v5 ~, }% x3 g

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11#
发表于 2017-12-27 09:16 | 只看该作者
1,不用光耦,2,EN信号逻辑不正确

点评

哪里不正确?  详情 回复 发表于 2017-12-27 12:34

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12#
 楼主| 发表于 2017-12-27 12:34 | 只看该作者
kewin_wang 发表于 2017-12-27 09:160 P! P! X( |/ o7 [  O
1,不用光耦,2,EN信号逻辑不正确

; z6 z3 m. z* _2 U哪里不正确?5 q" y+ x) f6 V" F

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13#
发表于 2018-1-3 10:56 | 只看该作者
你参考一下。
+ x% Q! U4 A6 G4 o " [5 y8 w1 Z& r

点评

您好!我仔细研究了下你这个电路,无论是在3光耦模式还是在2光耦模式485收发芯片的使能脚(RE、DE)都很重要。2光耦模式下时自收发电路,3光耦模式是带使能控制的收发电路。但是有一点我不是很明白在485自收发电路中  详情 回复 发表于 2018-5-10 10:33

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14#
发表于 2018-4-27 00:01 | 只看该作者
就是TLP2368的输出引脚没有接470欧姆的上拉电阻的问题。因为这个光耦看起来自带电源引脚,但是输出引脚却是集开门输出的。

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15#
 楼主| 发表于 2018-5-10 10:33 | 只看该作者
yidanshuxuexi 发表于 2018-1-3 10:56
6 C( i& S6 c( E: {3 G你参考一下。

% }" T; H/ k9 v- f' A1 v您好!我仔细研究了下你这个电路,无论是在3光耦模式还是在2光耦模式485收发芯片的使能脚(RE、DE)都很重要。2光耦模式下时自收发电路,3光耦模式是带使能控制的收发电路。但是有一点我不是很明白在485自收发电路中在接收总线上的数据时,TX一直是高电平吗?+ P9 Y7 ?$ ~. ~$ R, u# g' x% ?* O
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