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allegro 17.2 怎么建立Xnet

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1#
发表于 2017-8-5 15:34 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
15金币
本帖最后由 tiny丨Y 于 2017-8-12 10:28 编辑
& ?# F$ l: A, Y1 G5 R6 o, ^) a" h+ v0 |0 \' ^( ^4 o
问题如题我不是小白3 S) b+ T7 S# W- e0 K) l& @
用signal model assignment方法试过了,建立失败
3 z" [) }, O! i! K6 `请用17.2试过成功的大神帮忙解决& u0 _& f/ h) j) M) {
版本17.2 S094
4 _& r: z, p; V+ q感谢rock_li29的帮助:可能是你的BRD文件数据有问题,提示电源和地网络有问题,重新开一个新的BRD file,把现在的器件,走线,铜皮贴到新的BRD文件可以设XNET.) K2 Z* S! n5 X. Y: |9 ~1 d
2 d& M! w# s, n. D7 T' r
. J% I) \& @9 N
已确认解决,但还是没找到为啥 原来的brd不能设置 继续求助- B* C3 |* N% \! o, R

最佳答案

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附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

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2#
发表于 2017-8-5 15:34 | 只看该作者
tiny丨Y 发表于 2017-8-7 09:44. r, _0 w: M% ~: Z
方便加个QQ2542796636 附件不好上传
) O  _" s! `) b- d7 d/ O1 L& T
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。
3 t& @9 F7 x7 p' t! D* G& U2 w

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附件  详情 回复 发表于 2017-8-8 14:45

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3#
发表于 2017-8-6 17:59 | 只看该作者
没有用过17的版本

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4#
发表于 2017-8-7 09:18 | 只看该作者
17.2的补丁已经到094了吗?

点评

057吧  详情 回复 发表于 2019-8-7 13:14

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5#
发表于 2017-8-7 09:33 | 只看该作者
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。
. c/ i* N- U  `1 X( L; S3 Q$ ]

xnet.png (47.96 KB, 下载次数: 7)

xnet.png

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方便加个QQ2542796636 附件不好上传  详情 回复 发表于 2017-8-7 09:44

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6#
 楼主| 发表于 2017-8-7 09:44 | 只看该作者
rock_li29 发表于 2017-8-7 09:334 n1 t# V' ^( p9 d7 K" N. ^% M& [
跟16.6的方法是一样的,可能是的BRD文件有问题,方便的话可以把BRD文件附上来帮你看看。

. T# L( B! C1 y* Z/ m8 y方便加个QQ2542796636 附件不好上传

点评

附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。  详情 回复 发表于 2017-8-8 10:14

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7#
 楼主| 发表于 2017-8-8 14:45 | 只看该作者
本帖最后由 tiny丨Y 于 2017-8-8 15:01 编辑
3 Y! s- w  I+ v0 v9 z% @
rock_li29 发表于 2017-8-8 10:14( X# Z5 O/ O4 e- `8 y0 P0 ~
附件先大吗?不大的话可以压缩后上传到论坛上,PCB文件不方便公开的话加个密码,私信给我。

, E8 D' j$ e4 S私信你了

pcb.zip

1.22 MB, 下载次数: 32, 下载积分: 威望 -5

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8#
发表于 2019-8-7 13:14 | 只看该作者
zuoanwind 发表于 2017-8-7 09:183 r( E1 t9 N$ _- w- w2 ?2 l
17.2的补丁已经到094了吗?
- v1 Q! I) `: P& d+ L
057吧
$ X0 Q( Y, v- u% w% r, H1 o6 }4 u

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9#
发表于 2019-8-8 05:59 | 只看该作者
17.2的问题。

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10#
发表于 2019-8-8 06:07 | 只看该作者
不方便截图,这是新找到的,是17.2的问题
4 J# y. m( ^; T
& r* P/ f8 D2 u4 X( j' g2 K8 ?1 O& u1.Close the design if it is open in Allegro PCB Editor.
% C8 ?! Q3 i2 J2.Add the CDS_XNET_STATE_UI variable​ with a value of 1 to the User variables section in the Environment Variables form.& {6 z: s/ N/ z# _! w/ X
3.Open the design in Allegro PCB Editor.4 e) b9 G0 i' b
4.Go to File > Import > Logic and, if not already set, set the Import Logic Type to Design Entry HDL.
( P! V5 T* n; Y( m5.Open Constraint Manager.
# T/ A; ]5 p# X6 |& W6.Select Tools > Options.
) B5 m$ a. M; [+ m' ^7.Select the Create XNets and Differential Pairs using DML Models (same as SPB 16.6) option.
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    2022-11-28 15:00
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    11#
    发表于 2019-10-28 11:40 | 只看该作者
    今天我也是遇到了,17.2不能创建XNET。。。
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    12#
    发表于 2019-10-28 11:45 | 只看该作者
    版本17.2 S094  能分享下S094的补丁?

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    13#
    发表于 2019-10-28 19:55 | 只看该作者
    試試.謝謝!
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    14#
    发表于 2020-3-13 11:44 | 只看该作者
    THANK YOU.
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    发表于 2020-3-17 13:41 | 只看该作者
    谢谢分享
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