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allegro 16.6 如何设定不同Net 短路时又不会出现DRC

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1#
发表于 2017-5-4 12:26 来自手机 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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请问大虾allegro 16.6 如何设定不同Net 短路时又不会出现DRC?

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3#
发表于 2017-5-4 13:37 | 只看该作者
短路肯定有DRC的,没有DRC才是有问题的。
% Z" M, Z# ^# W% C9 U建议最好留着DRC,你可以不用理会它,防止后面忘记了,有个DRC可以知道的
% P& x- r9 ?- O
$ ^7 X6 D, X0 ^6 L7 E& l& V不同网络如果需要短接,你如果不想出现DRC,可以另起一层(非走线层)画个线短接,  `, c0 f" j" I& |0 _
但是你设置光绘时候记得把这个线设进去,否则走线层没有这个线生产出来是开路的

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4#
发表于 2017-5-4 13:50 | 只看该作者
短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层)端接即可,光绘设置时记得把那个非走线层的线设置加进去,否则就不链接了。
  h$ i% w2 l/ _% Q1 g/ D

点评

请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber  详情 回复 发表于 2017-5-4 13:58

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5#
 楼主| 发表于 2017-5-4 13:58 | 只看该作者
superlish 发表于 2017-5-4 13:500 R7 @* O) R2 n9 _6 q+ U- n
短接点建议可以建个封装,(记住不要开窗,这个不需要焊接的),前后网络可以不一样,中间画个线(非走线层 ...

+ b! y. G- W3 f' P7 b/ }请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber" W. n4 x5 K' z# F

" b, m9 K/ j  ?
9 W5 @! J: |! s% V
6 g0 G% A' z9 l) q

QQ图片20170504135729.png (33.4 KB, 下载次数: 15)

QQ图片20170504135729.png

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请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。  详情 回复 发表于 2017-5-4 15:08

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6#
发表于 2017-5-4 14:57 | 只看该作者
强连也可以出GERBER的$ ?. {$ f; x* _& Y' _
最好自己定义单独一层,防止和其他信息冲突
  y; l) I' Z- J8 |5 |& e 0 L1 C6 U$ {7 i) E' H8 c

2 D' B$ O4 ~/ ^

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7#
发表于 2017-5-4 15:08 | 只看该作者
finezhang 发表于 2017-5-4 13:58  s6 t) S( Q6 I: j, y& y
请教在哪层画线,出gerber时怎样添加这一层?强行连接DRC没办法出gerber

/ I& w. o+ k8 D5 q& O8 s5 a7 z, t请问下你这个有在原理图上有标示出来的吗? 最好原理图也标一下,要不下次改版或者换别人做就不清楚这里强连是什么意思了,别人估计会当做短路处理了。
; e  @* }3 O# }0 l+ t2 {- x  W3 \- I6 Q: q: j; ?7 f

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8#
发表于 2017-5-4 15:22 | 只看该作者
还有一种短接的,铜靠近点,弄最小间距不报错就OK,然后开钢网,一刷锡膏就连上了 , ]1 N& ?0 F1 J& F
2 u+ h% q6 \; ^) \( }/ E

) |, ]0 Z- Y: @3 K% j& ]; ]$ c
4 X" Y0 \1 a2 W' B# h) y

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9#
 楼主| 发表于 2017-5-4 15:39 | 只看该作者
没有明白怎样在封装里面:添加2个中间画个线(非走线层)1 f! a+ e2 q- i4 N8 m8 S
333层怎样添加的

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[attachimg]126702[/attachimg]  详情 回复 发表于 2017-5-4 16:14

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10#
发表于 2017-5-4 16:14 | 只看该作者
finezhang 发表于 2017-5-4 15:39
% V, P; m5 V' \6 c1 d; K没有明白怎样在封装里面:添加2个中间画个线(非走线层)
! T3 X6 b% N- q- k6 O2 ?333层怎样添加的
: U- ~1 o4 s, d" R5 H, _
: h3 W5 M* p+ b

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元件如果放到底层,top和bottom层怎样区分?  详情 回复 发表于 2017-5-4 17:35

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11#
发表于 2017-5-4 16:57 | 只看该作者
不出现DRC自己都不知道短路了

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12#
 楼主| 发表于 2017-5-4 17:35 | 只看该作者
6 H' O' @7 A; y! k/ f
元件如果放到底层,top和bottom层怎样区分?7 t: b2 ?% R, H% I  U: }

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不明白你要说什么?? 放哪层就是哪层啊  详情 回复 发表于 2017-5-5 19:56

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13#
发表于 2017-5-5 17:27 | 只看该作者
一般一个板子允许短路的地方不会很多,允许短路的地方自己做的板子自己心里很清楚,把允许短路的drc隐藏即可,搞得那么麻烦!

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14#
发表于 2017-5-5 19:56 | 只看该作者
finezhang 发表于 2017-5-4 17:35
. j7 X3 w0 a: g6 }* C* w) u元件如果放到底层,top和bottom层怎样区分?

2 @7 Y% Q- K8 p6 o不明白你要说什么?? 放哪层就是哪层啊- _( q# ?6 D- \$ ~# E. c3 T1 O- [; Q

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已搞定,谢谢大侠耐心讲解!  详情 回复 发表于 2017-5-5 18:11

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15#
 楼主| 发表于 2017-5-5 18:11 | 只看该作者
superlish 发表于 2017-5-5 19:56# ?$ C# I$ |& f' d
不明白你要说什么?? 放哪层就是哪层啊
5 L3 m1 r  U6 P6 S# H) i% H# I7 m
已搞定,谢谢大侠耐心讲解!, x; p& s( P8 Q: B

123.png (23.04 KB, 下载次数: 10)

123.png
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