为什么FPGA IO设为高阻时测量其对高电压电源会有电压值？

hao2012 · 发表于 2016-12-25 11:49

EDA365欢迎您登录！

您需要登录才可以下载或查看，没有帐号？注册

x

如图示，FPGA的BANK 电压是3.3 V，设计失误外面分压设为5,6V左右（不清楚会不会烧坏IO口），但是实际测量时电压值达不到5或6V，只有3.7V左右，把外围都删掉就像图片中那样的电路后测量其对地是没有输出的，但是对高电源能量出电压来，有没有了解的大侠帮忙解答一下？我个人猜测是IO口的保护电路影响的原因。

djadfas · 发表于 2017-1-4 11:49

为啥要测12V和IO 他们之间没什么联系

donerlin2007 · 发表于 2017-3-24 22:19

一般IO口有一个保护二极管。若你外围输入一个5V电压，二极管会把电压拉低至3.3V

帐号		自动登录	找回密码
密码			注册

为什么FPGA IO设为高阻时测量其对高电压电源会有电压值？

EDA365欢迎您登录！

浏览过的版块

推荐内容 /1