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生成网络表时又遇难题,请真正的高手解答

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1#
发表于 2008-11-25 14:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在原理图生成网络表时,遇错中断了,提示有定义成“NC”的网络存在,但我查遍了整个原理图,没有这样的网络,不知什么人原因,恳请高人指点!!!
9 ~# c; C& R7 u$ a+ @
: g: J$ D( ?6 Y# A% `) y
; b  L' c9 m, {  ?3 z, L********************************************************************************
; Y, p# ^2 s" e% m$ @" t*+ x. x8 O  z- F3 y& R8 w2 l2 H
* Netlisting the design 5 ~% x, N: x& J6 ^( u9 K5 I
*' H' H; t5 o9 D8 X5 u4 K
********************************************************************************
2 S4 @9 B5 h1 x' S4 n6 x) ^Design Name:  e3 r/ k+ g. H" L2 D: c1 T  _
E:\IP-CAMERA\ip-camera2.dsn8 }- p/ {0 E5 k" T  @% T- Z
Netlist Directory:% w" N' q) P9 I- a% Y9 d; `
E:\IP-CAMERA\allegro
) w* \  k# ^! bConfiguration File:2 Q! m% c/ k4 P0 G- m9 n& V% x" \
D:\cadence\SPB_16.0\tools\capture\allegro.cfg6 C7 F2 k( P5 \) @! s: ]
Spawning... "D:\Cadence\SPB_16.0\tools\capture\pstswp.exe" -pst -d "E:\IP-CAMERA\ip-camera2.dsn" -n "E:\IP-CAMERA\allegro" -c "D:\Cadence\SPB_16.0\tools\capture\allegro.cfg" -v 3 -j "PCB Footprint"" W/ z+ M( g# v5 E4 h9 L" q3 q, E
#1 Error   [ALG0043] Net named "NC" found on the design. Please rename the net.
8 N% L; {& y9 N5 |& W#2 Aborting Netlisting... Please correct the above errors and retry.2 O! Y& o$ t. \  }
Exiting... "D:\Cadence\SPB_16.0\tools\capture\pstswp.exe" -pst -d "E:\IP-CAMERA\ip-camera2.dsn" -n "E:\IP-CAMERA\allegro" -c "D:\Cadence\SPB_16.0\tools\capture\allegro.cfg" -v 3 -j "PCB Footprint"
5 @) G" j7 w8 g& _
: M! t' C* x8 Z, G5 K9 F*** Done ***

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2#
发表于 2008-11-25 15:09 | 只看该作者
呵呵 做网络摄像机的 应该是你某个元件有多个命名为NC的管脚引起的,你把封装改下就OK了,试一下吧,我不是高手。3 V% F1 g2 K, W- g% Z- B

+ [6 K2 |! t3 ~7 R! S" f7 w/ z, r  {[ 本帖最后由 nikcyp 于 2008-11-25 15:39 编辑 ]

该用户从未签到

3#
 楼主| 发表于 2008-11-25 17:27 | 只看该作者
楼上的兄弟说的对,我把管教名定义成“NC”的全改了,改完这个问题就没了。但这些管教之前我都定义成“power”性质了,还能出问题,看来ORCAD问题不少。

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4#
发表于 2008-11-25 22:41 | 只看该作者
定义成POWER的PIN一定要连接的
: g3 C1 T8 z* }5 P9 H你想打空脚符号“X”是打不上的
: Z% r" I5 Q0 z: |所以系统默认你设计的原理图是没有OVER的. f; u" H# b+ {1 t
建议网表前DRC一下
5 \8 @+ }6 D, z  L: K: K这些问题就迎刃而解了
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