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楼主: fh3953
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求助,原理图位号重排之后更新网表到pcb就乱了

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16#
 楼主| 发表于 2016-3-6 19:07 | 只看该作者
longzhiming99 发表于 2016-3-6 09:12
. q& O' W) r% c9 w! U很多人遇到过,但次数不多,始终不知其原因所在,原因是PCB上有fix属性的东西,任何东西!有了fix就会更 ...
0 @& }9 p: ?, r% _; u# u
多谢提醒,不过我好想没有fix的器件啊。。。明天上班再确认下" Y: x& @4 C+ z

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包括走线也不能fix,我是在17.0版本上验证的。以前用16.5也遇到过。  详情 回复 发表于 2016-3-7 09:19

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17#
 楼主| 发表于 2016-3-6 19:11 | 只看该作者
partime 发表于 2016-3-6 15:02/ o, _% v/ s/ }( A: a8 ?9 n
用原来的brd文件反标到HDL里面去,然后,让DE在这个基础上做原理图。不是你麻烦,就是他麻烦
& j" }2 t. C5 U7 E$ X
然而并没有你和他,只有一个我....7 P7 |4 t' u5 f# n! v
小公司的硬件就是全包啊全包。
2 X5 R: |5 T( G# Z. y* {2 P( m还有就是我在brd里面重排位号,位号的前缀都会变掉,电阻都变成U了,这个怎么解决?是不是得在器件封装里面改?
9 z: W2 w) W& w6 R% U6 v2 w

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同求,我也遇到同样的问题  详情 回复 发表于 2022-1-10 21:27

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18#
发表于 2016-3-7 08:47 | 只看该作者
变了是正常的,位号变了,导致网络也跟着变,一般改版修改原理图,我们都是建议客户,在原来的原理图上手动添加位号,不然以前的板子基本上都是不能用!

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19#
发表于 2016-3-7 09:19 | 只看该作者
fh3953 发表于 2016-3-6 19:07
% h3 d2 l2 m6 H& V, `多谢提醒,不过我好想没有fix的器件啊。。。明天上班再确认下

, n& w& f8 N) J; g* Y包括走线也不能fix,我是在17.0版本上验证的。以前用16.5也遇到过。
0 T+ `. O0 g5 J! E) s. D

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我今天看了,不是这个问题,这个板子没有结构要求,我没有fix任何东西  详情 回复 发表于 2016-3-7 09:32

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20#
 楼主| 发表于 2016-3-7 09:32 | 只看该作者
longzhiming99 发表于 2016-3-7 09:19
3 U' X- E1 {  ], Y3 X  d+ L包括走线也不能fix,我是在17.0版本上验证的。以前用16.5也遇到过。

% f4 Q/ s4 ^/ Z1 L+ L8 f/ P我今天看了,不是这个问题,这个板子没有结构要求,我没有fix任何东西

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21#
发表于 2016-3-7 11:20 | 只看该作者
在PCB里面重标,然后反标到原理图中。参考附件反标的文档. allegro重新编号,反注到原理图枫亭阁新浪博客.pdf (763.03 KB, 下载次数: 44)

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支持!: 5.0
支持!: 5
搞定了,多谢!  发表于 2016-3-7 14:37
多谢!之前没勾preserve currente prefixs,所以重排一直有问题。现在重排可以了,但是回注的时候提示Unable to read physical netlist data. 求解,这个怎么破? 下面是log,能否帮忙看看,谢谢! Spawning.  详情 回复 发表于 2016-3-7 14:31

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22#
 楼主| 发表于 2016-3-7 14:31 | 只看该作者
lxh19861215 发表于 2016-3-7 11:20# a# p/ Z1 V) l, d8 A# X0 |
在PCB里面重标,然后反标到原理图中。参考附件反标的文档.
+ Q% W+ H# B1 k8 ]1 x
多谢!之前没勾preserve currente prefixs,所以重排一直有问题。现在重排可以了,但是回注的时候提示Unable to read physical netlist data.
; z, [3 e1 n; E0 J) n5 Z4 q3 ]: a求解,这个怎么破?
; L& p  t; A5 [
# V8 J: h+ [  D( H下面是log,能否帮忙看看,谢谢!0 d/ f7 J/ R/ `) b3 {3 e6 o% j3 F
' Y  g% N$ K  ]% j# a
Spawning... "E:\Cadence\SPB_16.6\tools\capture\pstswp.exe" -swp -d "D:\SPB_DATA\6735\YYW-M-6735-DEV-10-20160306.DSN" -n "D:\SPB_DATA\6735\ALLEGRO" -s "D:\SPB_Data\6735\rename.swp" -c "e:\Cadence\SPB_16.6\tools/capture/allegro.cfg"  -hpath "HPathForCollision" -backwd0 w% T. ~/ y( P1 K  w
unzip:  cannot find either feedbackview.cdsz or feedbackview.cdsz.zip.
& B2 q. H& Y; g' z. H! qINFO(ORCAP-36108): Starting the Swp file dumping process ...3 a2 d6 e2 s8 w% b- `# U  U
Loading netlist files ...# m( F, b$ ^9 F3 h7 q
Loading... D:\SPB_DATA\6735\ALLEGRO/pstchip.dat+ ?2 `( f" O- X; j; e7 W

& _8 Q. c  X( f$ o4 `$ W/ l5 ]3 mLoading... D:\SPB_DATA\6735\ALLEGRO/pstxprt.dat/ H4 U1 S# Y2 B) N  ~. F$ C, e* s

$ Z4 M0 z% p7 z: _" ~Loading... D:\SPB_DATA\6735\ALLEGRO/pstxnet.dat5 X8 z; d  _. o' z" ^* m  a
packaging the design view...Loading physical design view ...Loading... D:\SPB_DATA\6735\ALLEGRO/funcview.dat
/ W6 i1 x1 R( x* Y6 p! _# y#549 ERROR(SPCODD-549): No physical part found for COMP_DEVICE_TYPE=PJ-393_PJ-393_PJ-393, regenerate the netlist to sync with Allegro board.. f  Q. D) e0 L
              ERROR(SPCODD-516): Line Number: 1786 W! ~5 {, M6 J0 O# P0 U1 e6 P
#1 ERROR(ORCAP-36027): Unable to read physical netlist data.# f) u+ f2 \5 Y3 @3 v! G
#2 ERROR(ORCAP-36025): Aborting Swap file creation... Please correct the above errors and retry.
" b: M6 w( F7 @% B5 ?
, ]  {7 d" L& V) P8 cExiting... "E:\Cadence\SPB_16.6\tools\capture\pstswp.exe" -swp -d "D:\SPB_DATA\6735\YYW-M-6735-DEV-10-20160306.DSN" -n "D:\SPB_DATA\6735\ALLEGRO" -s "D:\SPB_Data\6735\rename.swp" -c "e:\Cadence\SPB_16.6\tools/capture/allegro.cfg"  -hpath "HPathForCollision" -backwd
+ F8 Q, u+ @  [6 b$ J4 B4 q: ~INFO(ORCAP-32005): *** Done ***
8 U0 P8 C7 A# _; u* {
3 k! z/ c; d4 B9 P4 k% C+ [7 `- A, Z; i8 |% n* u

9 @3 K1 @5 i: {2 E5 h3 F, B
: w. v& ?/ ?! ^

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搞定了,出这错误是因为重排后的pcb没保存,现在可以了。 感谢楼上大大们的回复  详情 回复 发表于 2016-3-7 14:36

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23#
 楼主| 发表于 2016-3-7 14:36 | 只看该作者
fh3953 发表于 2016-3-7 14:314 J& b  p* A" L7 K7 u% R
多谢!之前没勾preserve currente prefixs,所以重排一直有问题。现在重排可以了,但是回注的时候提示Una ...

' h* e" e* N+ l; v/ k搞定了,出这错误是因为重排后的pcb没保存,现在可以了。. N# c8 s. \3 ^7 a& {. K
- p, Y4 S% }1 {
感谢楼上大大们的回复
% ?+ w( t; d4 O" v3 o

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24#
发表于 2016-3-10 11:57 | 只看该作者
我也想知道,怎么解决这个问题!

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现在看来是软件固有的问题,只能在pcb重排并回注了  详情 回复 发表于 2016-3-10 13:56

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25#
 楼主| 发表于 2016-3-10 13:56 | 只看该作者
lzh4774 发表于 2016-3-10 11:57. F% c1 S3 C: Z4 }) Y1 |; C
我也想知道,怎么解决这个问题!
; @+ C) g% ^7 \9 n
现在看来是软件固有的问题,只能在pcb重排并回注了1 F7 l2 h# S$ v# I' X; @

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26#
发表于 2016-3-10 13:56 | 只看该作者
试试把原来的PCB位号锁定~

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27#
发表于 2016-5-25 09:24 | 只看该作者
只能回住了

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28#
发表于 2022-1-10 21:27 | 只看该作者
fh3953 发表于 2016-3-6 19:11
. h+ d. f) ^* Q" H然而并没有你和他,只有一个我....2 W8 A- R1 p8 L& E
小公司的硬件就是全包啊全包。7 N7 g8 ~2 ~! B( w2 t" t3 o$ b) `* G
还有就是我在brd里面重排位号,位号 ...

6 c: M( O7 O( m' j9 o% Q+ @同求,我也遇到同样的问题
4 J( w) c4 H* T, e& o3 ]
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