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FPGA外围硬件电路设计

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1#
发表于 2015-12-22 23:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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菜鸟请教个问题,FGPA外围电路设计时,外围芯片怎么跟FPGA链接啊,比如以太网收发器的控制引脚直接接到FPGA的随便哪一个IO上都可以,还是要接到相应的指定的IO上?
. O9 f  y( J1 Y: s9 r- k3 T( v

点评

是指 MII / GMII / RGMII 管腳的安排嗎?例如說……  发表于 2015-12-23 18:35

该用户从未签到

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发表于 2015-12-24 08:27 | 只看该作者
答案是不能隨便安排的,因為引腳的安排會影響到 FPGA 運行的極度, 甚至有些時鐘相關的引腳也要從  FPGA 特殊的引腳進出。
4 A7 q) A; |( P# Z
, [0 I& q# A5 d% x! \0 e" x感覺樓主是要在 FPGA 上放一個 Ethernet MAC︰
8 G1 w, c9 v' k! m
  • 如果是自行設計 Ethernet MAC,通常一開始可以選擇讓軟件自動排列引腳,並選擇優化的條件以速度為優先。
  • 如果是用現成別人提供的 IP,通常他們會指定 FPGA 型號及引腳位置。
  • 兩種設計引腳都可以做微調,不管是為了美觀、還是線路佈局(PCB Layout)方便,但前提是要滿足介面運行的速度。
  • 以 10Base-T 的 MII 來說,因為運行的速度慢,如果你的 FPGA 夠快的話,微調的彈性就會較大。1000Base-T 的 RGMII,可能相對限制就較多。
    % C9 ^% |0 m# v, T& ~
: g8 g. X1 ~9 S, b8 g- U
. c  v' o" j& w
* F9 A  q1 Z7 @
! [; L1 v. b8 E6 k4 A8 ?! I

该用户从未签到

2#
 楼主| 发表于 2015-12-23 21:38 | 只看该作者
回复超级狗:就是您说的意思,就是这些类似外围接口收发芯片的控制使能引脚的安排,怎么跟FPGA的IO连接,是随便找个bank的IO连上就可以还是要与指定的IO连接。例如说xilinx a7的FPGA控制RGMII的以太网收发器,收发器的引脚怎么跟FPGA连接

该用户从未签到

4#
发表于 2015-12-24 08:38 | 只看该作者
Xilinx AC701 Ethernet Design Example# Q1 G. A+ M% c) o1 D

) B' u* p% }- C/ ^( n8 s1 g有開發板耶~6 j- M9 v. x" Y) g9 X7 O

# ^( P' V2 c- r" F& R0 {
) I6 K3 c- l5 n" u6 i: x  ohttp://www.xilinx.com/support/documentation/boards_and_kits/ac701/2014_4/xtp223-ac701-ethernet-c-2014-4.pdf
  q7 g/ V9 \, t( M
2 I8 V, f8 Q" {0 O- x0 n7 n' x

点评

好嘞,大概了解了,非常感谢您的帮助!!  详情 回复 发表于 2015-12-24 10:11

评分

参与人数 1威望 +2 收起 理由
chrischouchou + 2

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该用户从未签到

5#
 楼主| 发表于 2015-12-24 10:11 | 只看该作者
超級狗 发表于 2015-12-24 08:380 c" I& k8 Q  t' Z
Xilinx AC701 Ethernet Design Example
  Q% D+ }8 A" X, S) s1 x5 [' [2 i+ z. g' B+ q) T- T
有開發板耶~
, L3 }% P' O3 {+ T" f+ [5 L
好嘞,大概了解了,非常感谢您的帮助!!" c, t) B& c$ ?% k+ Y0 F
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