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有个阻抗的问题,一直搞不明白

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1#
发表于 2015-9-6 17:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有个最抗的问题,一直搞不明白,  书上说在走高频微带线的时候,对地最抗要求50欧姆, 通过调整线与地线参考层的距离来调整阻抗;% L9 x- b& E& M( y2 c/ M
我可以这样理解吗 ,这个阻抗是高频最抗,对地阻抗是对某一个频率而言的,如果频率变了,这个阻抗也会变;4 m& S, E0 R7 f: v1 h7 c* `

; z6 y, ?( w7 A$ E6 f, }' ^那么在很多资料中的 微带线50欧姆最抗,是对哪一个频率来说的呢?  10M?  100M?  1G? , 谢谢大家指导。
/ a" w* D7 `( y8 G3 v

该用户从未签到

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发表于 2015-9-6 18:01 | 只看该作者
你的问题比较有意思。阻抗确实是与频率有关系的,一般情况来讲,很多在介绍阻抗的时候都是不加频率的。如果是PCB设计,很多都是按1M的参数来确定其阻抗。你可以通过调整参考层的距离或者是线宽来改变阻抗。如果是差分的话可以调整间距。当然如果可以改材料,也能改变其阻抗。

点评

哦,非常感谢啊, 画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢  详情 回复 发表于 2015-9-6 18:24

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 楼主| 发表于 2015-9-7 13:15 | 只看该作者
菩提老树 发表于 2015-9-7 11:172 f4 ~; y% ]+ _8 _
连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问 ...

( O2 G. y1 s1 l' t6 s5 l7 O“阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?,
2 W# e8 z6 s6 Q1 [! J再请教一下啊,比如说这种情况   一个CPU高速数据信号到 SDRAM缓存的输入结构, CPU输出端口是有一定阻抗的, SDRAM的端口是有一定阻抗的, 假设中间型号线已经做了50ohm的对地阻抗匹配了,那么怎么做对两个端口的 最抗匹配呢,求高手解啊,谢谢啊;
( B1 d' K* i) W+ I6 L* r; ]; U% ?4 h5 R% q9 E0 o8 q

点评

阻抗连续性就是整个链路的阻抗都一致。 关于你说的SDRAM的阻抗匹配也是一样的。  详情 回复 发表于 2015-9-7 14:49

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3#
 楼主| 发表于 2015-9-6 18:24 | 只看该作者
菩提老树 发表于 2015-9-6 18:01
# j7 |3 J+ m6 X你的问题比较有意思。阻抗确实是与频率有关系的,一般情况来讲,很多在介绍阻抗的时候都是不加频率的。如果 ...
6 T, P7 d$ E2 ~) O; `
哦,非常感谢啊,  画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢

点评

恩,没有问题,就这样计算就可以啦  详情 回复 发表于 2015-9-7 11:16

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4#
发表于 2015-9-6 18:55 | 只看该作者
高频的时候,阻 抗是要考虑的,阻 抗最怕是不连续, 100M、500M 时阻 抗变化不大。不要天天对阻抗的大小太较真。

点评

谢谢,前辈啊, 信号的连续性, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线, 怎么做到三个都阻抗连续呢,谢谢,求解啊  详情 回复 发表于 2015-9-7 13:18

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5#
发表于 2015-9-6 21:45 | 只看该作者
信号完整性上面是这么描述的。7 [/ M8 {. g. ?1 U  _' x% {
  y4 S2 u) d2 U. _
假设传输线均匀,信号在任何地方感受到的阻抗相同,这个阻抗值表示整个传输线的特性阻抗。(如50欧姆)
- p! f* ?# O( a2 b# M% F( f. R0 M  f7 o9 k- Z1 h0 F
无损模型:Z=L/C^1/2。& v. m2 s, A# F1 A2 F& H

' @  K" `9 o5 V! i/ V, l影响单位电容与电感就影响了特性阻抗。

点评

数年后,才发现,这一条是正确答案,TKS  详情 回复 发表于 2023-6-10 00:35
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    6#
    发表于 2015-9-7 08:46 | 只看该作者
    阻抗的连续性比阻抗的具体数值更重要。

    该用户从未签到

    7#
    发表于 2015-9-7 10:31 | 只看该作者
    学习了,连续比数值重要

    点评

    连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问题。  详情 回复 发表于 2015-9-7 11:17

    该用户从未签到

    8#
    发表于 2015-9-7 11:16 | 只看该作者
    leeping2d 发表于 2015-9-6 18:24
    / P# m6 d+ \! l/ [$ i哦,非常感谢啊,  画高频的 500M的板子,也是按照1M算阻抗的吗?求解,谢谢
    1 O- H3 m) u$ g1 T$ }6 _
    恩,没有问题,就这样计算就可以啦

    该用户从未签到

    9#
    发表于 2015-9-7 11:17 | 只看该作者
    kerwinash 发表于 2015-9-7 10:31
    # s& @% m$ }" C学习了,连续比数值重要
    ! M9 _0 r' U( N; d7 G
    连续性是很重要,但是要整个链路都连续。当然,如果是500M的信号(除了时钟信号),一般都不会有太大的问题。
    3 i2 U3 @2 j% U3 y$ c6 v# I0 }) C  s% u9 T

    点评

    “阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?, 再请教一下啊,比如说这种情况 一个CPU高速数据信号到 SDRAM缓存的输入结构, CPU输出端口是有一定阻抗的, SDRAM的端口是有一定阻抗的, 假  详情 回复 发表于 2015-9-7 13:15

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    11#
     楼主| 发表于 2015-9-7 13:18 | 只看该作者
    True 发表于 2015-9-6 18:55- K7 S  D/ g. X7 D* h+ H' G
    高频的时候,阻 抗是要考虑的,阻 抗最怕是不连续, 100M、500M 时阻 抗变化不大。不要天天对阻抗的大小太 ...

    + Y4 Q0 R8 o* J* F6 k2 P7 A谢谢,前辈啊, “阻抗的连续性”, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线, 怎么做到三个都阻抗连续呢,谢谢,求解啊! ^" b% B* D# Y6 G5 q# y( Q

    点评

    呵呵,后面讨论的都对啊。  详情 回复 发表于 2015-9-7 15:13

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    12#
    发表于 2015-9-7 14:49 | 只看该作者
    leeping2d 发表于 2015-9-7 13:15% X8 ~& h+ l7 {* y
    “阻抗的连续性” 不是很了解,端接电阻是不是就是为了做这个的啊?,
    8 Y9 k, I, s+ E6 r再请教一下啊,比如说这种情况    ...

    8 ]2 j3 A9 w9 r( ^. i6 y% W! q阻抗连续性就是整个链路的阻抗都一致。
    2 i( j) ]1 ~+ r( n0 u5 `( r关于你说的SDRAM的阻抗匹配也是一样的。
    + |* y* V: D. ~" }/ i

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    13#
    发表于 2015-9-7 15:13 | 只看该作者
    leeping2d 发表于 2015-9-7 13:18
    4 b7 h/ o8 m7 d2 l谢谢,前辈啊, “阻抗的连续性”, 比如手两个芯片的高速数据通讯, 引脚输出,与引脚输入,加微带线,  ...
    0 U9 P. ^# t- S  X+ d, {
    呵呵,后面讨论的都对啊。   ) i! j6 F6 M9 Y' x3 N& v, U2 k

    该用户从未签到

    14#
    发表于 2015-9-8 08:51 | 只看该作者
    多多学习中 高频要理论的支持

    点评

    好的,有没有什么书推荐啊?  详情 回复 发表于 2015-9-8 16:50

    该用户从未签到

    15#
     楼主| 发表于 2015-9-8 16:50 | 只看该作者
    q270350800 发表于 2015-9-8 08:515 F6 X" V, D( H  c9 c) l' \- G
    多多学习中 高频要理论的支持

    ; A) C& d1 y/ \2 g9 t* f好的,有没有什么书推荐啊?
    ) G* [% D$ p% ~8 o; V
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