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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › DDR3基础及设计中的SI和时序问题
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楼主: 龙凤呈祥
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[Cadence Sigrity] DDR3基础及设计中的SI和时序问题

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clovep

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106#
发表于 2018-1-7 10:07 | 只看该作者
正需要，多谢

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EDA365微信号及QQ群号！
liu529343746

该用户从未签到
108#
发表于 2018-1-12 16:04 | 只看该作者
#在这里快速回复#看看咯……

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kuka_555

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112#
发表于 2018-1-14 11:55 | 只看该作者
感谢楼主分享
0 c/ D% X) D) o6 R$ u3 y

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shuaiwang

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115#
发表于 2018-1-15 18:55 | 只看该作者
xiexie fenxiang, l0 E% m" j2 L- w- X3 K8 M

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SFIRE

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117#
发表于 2018-1-23 17:02 | 只看该作者
看看，，学习下. B2 _% h: `( e" m$ h1 R/ d

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roykinglove

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118#
发表于 2018-1-30 11:29 | 只看该作者
学习一下，谢谢分享& `' A( N0 k2 [# o) T

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