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楼主: 龙凤呈祥

[Cadence Sigrity] DDR3基础及设计中的SI和时序问题

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qsmq46

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31^#

发表于 2016-5-31 19:54 | 只看该作者

谢谢分享资料

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曾瀚緯

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33^#

发表于 2016-8-5 16:09 | 只看该作者

謝謝大大分享

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龙凤呈祥

感谢支持详情回复发表于 2016-8-11 09:54

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龙凤呈祥

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34^#

楼主| 发表于 2016-8-11 09:54 | 只看该作者

曾瀚緯发表于 2016-8-5 16:09/ k* b2 j7 z8 ]) c5 W' U9 t
謝謝大大分享

感谢支持

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libing3062

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39^#

发表于 2016-9-17 10:36 来自手机 | 只看该作者

感谢分享,谢谢!

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lizongshan

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40^#

发表于 2016-11-30 17:00 | 只看该作者

Loss tangent

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惠是热奶茶

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41^#

发表于 2016-12-2 12:42 | 只看该作者

正需要，学习下

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sanzi102069

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43^#

发表于 2017-5-8 16:28 | 只看该作者

谢谢楼主分享~

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qq455144808

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44^#

发表于 2017-5-17 23:01 | 只看该作者

定最好能发DDR的时序仿真的例子

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好一一

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45^#

发表于 2017-5-23 17:34 | 只看该作者

学习学习，谢谢分享

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