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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › 铺铜问题~求助
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铺铜问题~求助

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Aiby2015

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1#
发表于 2015-6-10 11:05 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

. |8 |$ U1 J( I( s* @为什么会有这样的错误（是动态铜了）？下面是drc  o9 T7 G+ x& x
https://www.eda365.com/forum.php? ... mp;extra=#pid911826- K' M& ]$ p' c+ f

$ m) z/ _( S; F' c# j! X% s% i5 z- c" h
2 u& E1 V1 P8 b) I4 l2 A
9 \: g" h, n8 ^
LISTING: 1 element(s)6 t" H4 O; x3 L, j

4 v, u# w; j/ j+ r: ^) r           < DRC ERROR >
; h: n, k! Q! I* M2 V  Q1 o# Y  Q9 O  `- v, i' z
  Class:           DRC ERROR CLASS- I( H+ R# E4 L# {' X
  Subclass:        TOP' t$ ~& P6 O. t2 q& T/ Q
  Origin xy:       (2096.00 2275.00)" W5 t3 z& |" G9 S( \9 K5 n
  Constraint:      Line to Shape Spacing* Y" K% Y1 k# m4 C1 |7 D8 Z+ T
  Constraint Set:  DEFAULT3 ^+ G( f- ]2 J4 G+ y7 R( A
  Constraint Type: NET SPACING CONSTRAINTS
/ m# H0 H2 ]$ G* P" _' J5 |- E. G4 V1 N* @0 r3 d
  Constraint value: 10 MIL
8 X" i& s) W- V0 E5 r& J  Actual value:     0 MIL
' K3 M% `+ t& u1 O% ~& J# E1 a, v. a
  - - - - - - - - - - - - - - - - - - - -* E8 _7 o4 @* ?7 W% _3 e; s
  Element type:    SHAPE/ K7 |/ e. [% Y9 c
  Class:           ETCH
4 \9 y% e. W: [  Subclass:        TOP
# Y# ~- r* _. u4 |
5 C* P8 P2 w0 \2 X+ p' N* h- p. g  On a Dummy Net
0 k' P, B' v) W
4 h8 U8 ?# G' [* w  - - - - - - - - - - - - - - - - - - - -$ V) e* l, R! \: Q. R
  Element type:    HORIZONTAL LINE SEGMENT
9 ?+ T0 ~2 E: C! I  Class:           ETCH
3 [6 R! v0 l& |, L: `* N/ W  Subclass:        TOP
( }& W" _5 l6 U6 \, j# z3 j7 ]! J% t$ ~: K& z+ g) p% n
  part of a connect line' e$ c3 q! ~0 {7 q/ h! c+ G
  Part of net name: TXD
& ~1 Z* V0 l! w+ m( Y
' o0 P  u! w6 q' f( ]. D: ?segment:xy (2096.00 2275.00) xy (2203.00 2275.00) width (10.00)6 b% t( B$ {7 X  o, a; I

' m* T- B1 _3 p$ R4 m/ |

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3dworld

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发表于 2015-6-17 09:24 | 只看该作者
dzkcool 发表于 2015-6-16 13:20$ c6 E/ g* O4 p
你这跟楼主不是同一回事啊，确定走线的网络跟管脚是同一个吗？

: {/ |4 K3 e( [谢谢杜老师提示，网络跟管脚不是同一个。我走线的时候，忘记勾选find内的pin选项了。
" U9 u$ z6 X- @% q应该是在top层走了一段连接线，所以报错。8 o0 Z: ^9 A7 \* s
勾选上pin选项，就没有错了，问题解决。) I2 m" W, E" d9 `

  {3 {: i  w6 R( c4 d

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Aiby2015
解决了就好  详情 回复 发表于 2015-6-18 14:36

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3dworld

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发表于 2015-6-16 13:15 | 只看该作者
Aiby2015 发表于 2015-6-16 10:38
+ e& T) T& g( K  x可以了吗？

' x& |, T0 h+ O- l% p  Q  K没有解决。5 I$ K# B4 [0 [( m5 c
我的是在top 层出现的Line to SMD Pin Spacing 的DRC error
$ ~, [/ O- s3 f应该是我哪里弄错了。
  X4 `, b& n/ K! K
, W, X2 V! S' l6 }4 w9 {, A7 @7 O
( |/ {% F/ P; t9 u6 f( t7 |" ?8 V
  D( S# y& E7 i- u, l1 o- \/ U

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kinglangji
  • TA的每日心情
    衰
    2020-7-21 15:38

    • 签到天数: 21 天

    [LV.4]偶尔看看III
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    发表于 2015-6-10 11:19 | 只看该作者
    本帖最后由 kinglangji 于 2015-6-10 11:21 编辑 ' K4 }) w- ?1 R' Q: B. w- f
    Aiby2015 发表于 2015-6-10 11:06+ e, q( p- b" ~1 G& Y
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)
    4 |6 g' N2 Q$ {/ f2 W' u
    。。。。。。。貌似这样好像不出drc。。
    ) c$ |8 Z1 x4 r7 b. N) n

    捕获.JPG (60.37 KB, 下载次数: 9)

    捕获.JPG

    点评

    Aiby2015
    [attachimg]98046[/attachimg] 然而并没有什么*用~~~  详情 回复 发表于 2015-6-10 12:20

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    Aiby2015

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    2#
     楼主| 发表于 2015-6-10 11:06 | 只看该作者
    allegro新手学习记录贴 https://www.eda365.com/thread-108839-1-1.html (出处: EDA365电子工程师网站)

    点评

    kinglangji
    。。。。。。。  详情 回复 发表于 2015-6-10 11:19

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    Aiby2015

    该用户从未签到
    4#
     楼主| 发表于 2015-6-10 11:49 来自手机 | 只看该作者
    好 我试试看

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    Aiby2015

    该用户从未签到
    5#
     楼主| 发表于 2015-6-10 12:20 | 只看该作者
    kinglangji 发表于 2015-6-10 11:19
    8 n/ H8 v  G# t1 o8 ?- Q。。。。。。。貌似这样好像不出drc。。
    % f& ~' J7 A! Q2 l8 P* p/ s
      W, q7 U7 A5 I2 e: O! a3 G2 ]
    然而并没有什么*用~~~  V! z( n' z1 S. r9 P+ R+ Y$ U8 d; b

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    3dworld

    该用户从未签到
    7#
    发表于 2015-6-15 09:51 | 只看该作者
    我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。" h" G% |0 m: R! Y$ J. t
    同求答案。

    点评

    Aiby2015
    我的解决了 不知道您的是不是？  详情 回复 发表于 2015-6-15 20:06

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    8#
    发表于 2015-6-15 13:23 | 只看该作者
    不行就上传文件

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    Aiby2015
    感谢杜老师私下热心 指导  详情 回复 发表于 2015-6-15 20:07
    Aiby2015
    好了  详情 回复 发表于 2015-6-15 20:02

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    Aiby2015

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    9#
     楼主| 发表于 2015-6-15 20:02 | 只看该作者
    dzkcool 发表于 2015-6-15 13:239 k1 \/ s6 ?2 Y3 F7 Z8 e  u; B; |
    不行就上传文件
    5 j& p9 l8 Q& v# l' w- G* k, _- u
    好了
    5 T7 o0 v7 P. W. i0 d- A* X  e% a0 M; }4 d, I

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    Aiby2015

    该用户从未签到
    10#
     楼主| 发表于 2015-6-15 20:05 | 只看该作者

    8 H/ R, p+ s3 Z/ w8 K  v9 P我犯了低级错误，负片敷铜！2 Y" ~  `+ h* o/ O6 x2 w

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    Aiby2015

    该用户从未签到
    11#
     楼主| 发表于 2015-6-15 20:06 | 只看该作者
    3dworld 发表于 2015-6-15 09:51
    * |5 N  d1 Z* t' i我遇到了类似的问题，查看的约束管理器，觉得里面设置是对的。' t% X4 k: K% l
    同求答案。
    + V; M1 m) ^& U3 X) c: s5 a! S- g
    我的解决了 不知道您的是不是？8 B$ F9 ^; Z! T2 \" L& ~. x0 p

    点评

    3dworld
    我去试试看， 负片不能普通吗？ 在创建铜皮的时候，不是通常给负片Power层指定网络吗？  详情 回复 发表于 2015-6-16 09:37

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    Aiby2015

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    12#
     楼主| 发表于 2015-6-15 20:07 | 只看该作者
    dzkcool 发表于 2015-6-15 13:23
    - c0 _4 _3 T) M* v! e不行就上传文件
    - l- w4 T7 F  [  b: s0 |
    感谢杜老师私下热心 指导8 @- B6 j1 m/ E% Y5 e# [1 \

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    3dworld

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    14#
    发表于 2015-6-16 09:37 | 只看该作者
    Aiby2015 发表于 2015-6-15 20:06- I; N# B# d, i# J
    我的解决了 不知道您的是不是？

    / e. y3 V. b; v& P5 `3 g我去试试看，
    # B3 R4 _2 d6 D* E5 b: u% m负片不能普通吗？
    . ?! a; t8 a! |( c& F" U在创建铜皮的时候，不是通常给负片Power层指定网络吗？
    + k' b) `4 L, P( Z6 a

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    Aiby2015
    可以了吗？  详情 回复 发表于 2015-6-16 10:38
    dzkcool
    楼主是把表底层设置成了负片。  详情 回复 发表于 2015-6-16 10:32

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    dzkcool
  • TA的每日心情
    开心
    2024-2-21 15:59

    • 签到天数: 313 天

    [LV.8]以坛为家I
    15#
    发表于 2015-6-16 10:32 | 只看该作者
    3dworld 发表于 2015-6-16 09:37
    * B' W1 K9 |1 Q6 ]2 d9 c我去试试看，
    6 G' c$ u" Q- M0 ~5 ^( X负片不能普通吗？8 _; q5 o, T0 H2 |8 u9 o/ V# A
    在创建铜皮的时候，不是通常给负片Power层指定网络吗？

    8 v5 F" p+ T/ m- b5 K2 `$ f& D/ H楼主是把表底层设置成了负片。4 M3 g/ x/ I* ]0 ?

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