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请教各位大侠,cadence HDL如何生成网表?

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发表于 2015-2-25 09:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cadence HDL如何生成网表?) E1 o1 ]# ?8 z. f: s+ P  p
怎样更新到PCB啊
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    [LV.1]初来乍到

    2#
    发表于 2015-2-25 10:24 | 只看该作者
    在原理图中,file选项中export physical

    该用户从未签到

    4#
     楼主| 发表于 2015-2-25 11:39 | 只看该作者
    fishplj2000 发表于 2015-2-25 10:493 J- d4 u' @1 A5 i$ a* ]# Y: s* `
    楼上正确
    / W$ y1 }( x) \- W% ?; h
    那怎么调入啊,我们调网表一般就是第一方 第三方(TEL/TXT格式)啊/ N' q  n' I1 w& F/ i
    / g& P: m: G: B! R0 z
    非常感谢!
    * a! ?3 J# a# X+ c, v7 o8 V

    该用户从未签到

    5#
    发表于 2015-2-25 13:24 | 只看该作者
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹

    点评

    谢谢!  详情 回复 发表于 2015-2-26 09:01

    该用户从未签到

    6#
     楼主| 发表于 2015-2-26 09:01 | 只看该作者
    风刃 发表于 2015-2-25 13:24: G6 Z9 h  y! Y, `9 p
    直接调用第一方网表,就是那个file-import-logic,选择那个packaged文件夹

    " E4 I# K+ p5 `+ g& M谢谢!$ U2 A8 F) m! j  q
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