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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › Cadence 16.6 PDN IRDrop仿真问题
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[Cadence Sigrity] Cadence 16.6 PDN IRDrop仿真问题

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snsArvin

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发表于 2014-5-13 18:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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/ D% O. }+ v. P) H( b
各位大虾，小弟在运行cadence 16.6 PDN Static IRDrop仿真时，停在如下界面不前进，请问是否正常？3 c% u5 T: C% j+ L/ v
. l" ~5 @$ m" V/ u$ `: B% |
4 Y' j; m6 n( Z0 v+ Q
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感激不尽！5 e; T. U; m- H4 I; ~' [

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