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新手请教。如何用PLL做倍频,altera的Cyclone片子

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1#
发表于 2014-4-16 12:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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新手请教。如何用PLL做倍频,altera的Cyclone片子?/ @: E" j' d! }5 f) t2 T
还有是不是倍频一般都用PLL做,用VHDL或verilog做是不是很麻烦?/ i% L/ W7 w8 ~7 K# P
那么分频一般是用PLL还是用硬件描述语言来做呢?7 S9 j3 J, ~% f

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发表于 2014-5-6 17:33 | 只看该作者
lin899211 发表于 2014-5-6 10:35
0 i2 r6 I/ o& u, m谢谢,可是如何配置PLL呢?

+ O2 Z; _6 W6 o) k# O打开PLL 的IP配置界面,about里有使用文档。( y1 M- H. t% F, |
但是一般设计只需要设置PLL的输入时钟频率,使用多少路时钟输出,以及每一路的输出时钟频率就可以了,这些选型英文都很简单的,很容易知道哪个选项是干什么的,实在不行查查英汉词典。
- L4 k0 ?4 Y( S/ o谢谢。

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发表于 2014-4-17 08:25 | 只看该作者
lin899211 发表于 2014-4-16 17:21& W) F+ \8 i# z* K! @
谢谢!!!- a7 V* \/ g9 O; R% Y# L& Y2 e
请教一下,怎样使用PLL做倍频和分频呢?

; d, ^- P* @; {这个就容易了,你生成PLL的ip core之后,根据你的需要给PLL一个输入时钟并设置好参数,就可以得到你想要的输出了。具体怎么设,要看文档。

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发表于 2014-4-16 13:23 | 只看该作者
PLL可以产生倍频和分频的时钟,还可以根据需要进行相位偏移,以及满足不同的占空比。倍频时钟产生比较麻烦,一般不用自己写verilog来实现。分频时钟相对简单,容易用verilog实现,但是PLL生成的时钟更牢靠。

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3#
 楼主| 发表于 2014-4-16 17:21 | 只看该作者
lvsy 发表于 2014-4-16 13:23
( n0 c. H# p' P/ ^! g: FPLL可以产生倍频和分频的时钟,还可以根据需要进行相位偏移,以及满足不同的占空比。倍频时钟产生比较麻烦 ...

. X5 e& a* O" G8 N3 ]5 \3 B谢谢!!!% j2 M* U' X2 Q" W
请教一下,怎样使用PLL做倍频和分频呢?

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5#
 楼主| 发表于 2014-4-17 14:52 | 只看该作者
lvsy 发表于 2014-4-17 08:25
1 k. S. C3 _  Z  }, e; Y3 x这个就容易了,你生成PLL的ip core之后,根据你的需要给PLL一个输入时钟并设置好参数,就可以得到你想要 ...
( e, s' X; W0 C* {1 k
谢了

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6#
发表于 2014-4-23 10:14 | 只看该作者
这个都用PLL的!

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7#
 楼主| 发表于 2014-5-6 10:35 | 只看该作者
飞雪逐青 发表于 2014-4-23 10:14% j" n  d% D! @7 O4 @4 d2 P5 g: L
这个都用PLL的!
" [0 d, s* a" y; M1 Q3 C
谢谢,可是如何配置PLL呢?

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9#
 楼主| 发表于 2014-5-8 17:25 | 只看该作者
飞雪逐青 发表于 2014-5-6 17:33
  l* y8 X1 E' z' j5 E' F# y" @打开PLL 的IP配置界面,about里有使用文档。7 O  u/ ?% r' b$ Q+ e1 w
但是一般设计只需要设置PLL的输入时钟频率,使用多少路时钟 ...

& I1 }% T8 e7 a6 _: X非常感谢!!

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10#
发表于 2014-5-25 11:24 | 只看该作者
网上有例程 可以下来看一下

该用户从未签到

12#
发表于 2014-7-2 17:27 | 只看该作者
最简单的方法,直接把FAE喊过来!

点评

好方法!  详情 回复 发表于 2015-2-2 18:01

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14#
发表于 2015-2-2 18:01 | 只看该作者
技术流 发表于 2014-7-2 17:27/ h2 B# C, Y# q+ g4 H
最简单的方法,直接把FAE喊过来!
, o: }  e: t% _
好方法!
$ S/ C, r* f: L) S  X

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15#
发表于 2015-2-6 15:25 | 只看该作者
PLL配置详细说明.pdf (664.21 KB, 下载次数: 54)
3 [$ a8 Y6 D; d3 U2 ?0 Y* E! W& o8 m
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