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请问如何从datasheet里面得到fpga 的时序约束参数

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1#
发表于 2014-4-16 10:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
我是个新手,在看特权同学的视频教程,在看到他的关于时序分析的公开课时,有怎么也想不明白的地方,就来问问,也不知道标题起的会不会文不对题,各位见谅。, w0 E8 b$ W: A2 e, g$ M8 d( e

" F; b+ ]% W8 N1 z+ V0 S在这一篇文章中:http://www.61ic.com/Technology/embed/201304/48186.html8 ]' x) s4 P6 @  ^/ j' c# c, i) \
3 A2 b/ j' b  F- ~- p
特权给了一个例子,是pin to reg的一个时序例子,我对其中的
+ X4 [4 Y6 x3 B: B: NTco_max = Tpclk – Tsu1 u1 `# A) \& ~, ]3 H1 |. {  y: f

6 ?3 D9 V( _% {! [9 N! ^Tco_min = Th. g8 e8 y* d7 k6 X/ Y) t- d
深感疑惑,希望能得到各位的一些解答,另外以此为契机,也想问问各位是如何通过外部芯片的datasheet得到想要的时序参数,或者各位有没有什么学习文档可以提供,谢谢。

20130422152846707.jpg (25.53 KB, 下载次数: 2)

20130422152846707.jpg

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2#
发表于 2014-4-16 11:49 | 只看该作者
本帖最后由 lvsy 于 2014-4-16 12:24 编辑 % v: W+ u, S$ j% D( b! {
' K1 v0 x7 c  i) ]# S
这个图理解起来更容易一些。

timing.jpg (121.76 KB, 下载次数: 9)

timing.jpg

timing.jpg (121.76 KB, 下载次数: 2)

timing.jpg

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3#
发表于 2014-4-16 12:34 | 只看该作者
lvsy 发表于 2014-4-16 11:49& O" p2 [3 J  B& x
这个图理解起来更容易一些。

+ U9 L' Z* ^1 [' f图片怎么这么小?怎么删掉其中一个?

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4#
 楼主| 发表于 2014-4-16 15:10 | 只看该作者
lvsy 发表于 2014-4-16 12:34# Q2 t# i4 ?3 ~* Y
图片怎么这么小?怎么删掉其中一个?

$ O1 w3 J, P  D2 e% h6 b% e图片确实有点太小,难看,能不能说说图片的出处,我再去找找看。这个图片是关于什么的?

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5#
发表于 2014-4-16 15:19 | 只看该作者
烂泥桑 发表于 2014-4-16 15:10
. A/ a0 P* M' N* m8 E+ y. y图片确实有点太小,难看,能不能说说图片的出处,我再去找找看。这个图片是关于什么的?
  P- Z# b. G: l% g$ u2 _7 ^
这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。

mnl_timequest_cookbook.pdf

312.89 KB, 下载次数: 14, 下载积分: 威望 -5

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6#
 楼主| 发表于 2014-4-16 16:10 | 只看该作者
lvsy 发表于 2014-4-16 15:197 E) q. [4 F8 ^! s7 ?
这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。

, t5 L" U: r7 p9 @感谢,我先去看看。。。

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7#
发表于 2014-4-16 18:57 | 只看该作者
里面有参数的, 你在他手册里查 tsu  tco 会出来

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8#
 楼主| 发表于 2014-4-16 22:41 | 只看该作者
zgq800712 发表于 2014-4-16 18:57
9 l) X4 Z8 m3 ^0 s; o2 g里面有参数的, 你在他手册里查 tsu  tco 会出来
7 `/ }6 M: m& b4 c. ~0 a
朋友,帮人帮到底,你能不能截个时序图,参数图,举例说明一下。我知道是为难了,但还请指点一下,小弟入门不易啊

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9#
 楼主| 发表于 2014-4-17 16:45 | 只看该作者
lvsy 发表于 2014-4-16 15:19/ j5 [; [4 j1 M2 g: M$ S
这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。
6 }& |" X3 z. ]3 O3 A& g% Y6 _1 d9 j
最后在自己的YY下,我感觉自己给解释勉强可以接受,这个问题就到此为止了。
! J8 M+ A, O6 w6 ^7 v另外我在看你发的文档的时候,可以说看的一头雾水,能请教两个问题吗?
4 r% T) \8 X9 q' X  D' l7 }1 H. z/ I9 w
1、文档中那些像是描述语言一样的语句是什么呢,做什么用的?  {- {6 V* z! o8 B5 s# _1 }4 H. S0 Z

% S& }: ]# `3 Y* E/ {6 g5 ?2、文档中提到input_delay和output_delay,我在特权同学的教程里面也有看到,但是这对不同的系统(我的意思是FPGA时钟和外部ASIC的时钟的具体情况),这个input_delay和output_delay是否有同一个或者具体的定义。换句话说,就是当我获得整个系统各项的参数时,如何得知input_delay和output_delay由哪几项参数构成,从而写成表达式呢?

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10#
发表于 2014-4-17 17:19 | 只看该作者
烂泥桑 发表于 2014-4-17 16:45
  R, T- C" G" z& P, S' z* i* q& P最后在自己的YY下,我感觉自己给解释勉强可以接受,这个问题就到此为止了。
3 Z5 b+ S! V+ }另外我在看你发的文档的时候 ...
" Z) X7 I2 C: J( q5 x) o
1. 那些语句就是约束文件(*.sdc)的格式。* }) N: g; W* i& I
2. input_delay和output_delay对于不同的系统定义是一样的,但是具体值是不一样的,要根据跟FPGA相连的外部ASIC的I/O的具体参数来确定。
$ u5 \8 N8 S& m- C2 finput_delay和output_delay的最大最小值跟外部器件的Tco/Tsu/Th这些参数相关。

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11#
发表于 2014-4-17 20:13 | 只看该作者
本帖最后由 zgq800712 于 2014-4-17 20:14 编辑 1 o+ z0 W& G" y5 K
烂泥桑 发表于 2014-4-16 22:41
4 q& l* Z; }- P) C5 T( _- [5 O朋友,帮人帮到底,你能不能截个时序图,参数图,举例说明一下。我知道是为难了,但还请指点一下,小弟入 ...

8 E- b% p9 v9 [- ~
# z# ^: R. d  I" b不用查这些了。CPLD 可能综合下100多M,
+ g3 [- w' g' e. ?: @- R7 c6 }FPGA 同一个设计多达到了200多M的Fmax的报告。
/ t" t! D5 d# }8 Q2 J这些还不满足你的要求?先看看入门的,一步步来看。' W5 P3 M, t% I- k7 l, B8 c7 C
2 u4 |4 x( ?0 }
我可以说很多人书说上多说到timequest  ,但是基本多事照手册的来,没多少自己的见地。) d% Z4 J( a9 h! H7 M5 D# U) Y2 A$ _

6 z3 n" T# V: sHDL 硬件描述语言, 不是C程序设计语言, 好好想下描述语言和设计语言什么区别。' p2 }) q3 G' `& c& L# M

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12#
 楼主| 发表于 2014-4-17 23:00 | 只看该作者
本帖最后由 烂泥桑 于 2014-4-17 23:02 编辑 : \1 q4 u+ X# @) e: \' H0 a9 B
lvsy 发表于 2014-4-17 17:19
0 Y( P6 N+ t8 d( v! o6 e0 W) J2 ?1. 那些语句就是约束文件(*.sdc)的格式。
0 M& D% w+ U4 S. {7 \# u- Z2. input_delay和output_delay对于不同的系统定义是一样的, ...
# ~. m) R" O" A4 M! I( B7 M
# W* {1 u# U' V, J  A6 z, m
朋友你说“对于不同系统的定义是一样的”,这句话的是说他们的含义相同,还是说他们能以同一条表达式表述,只是各项表达式要按具体系统具体分析,得到相应的值?
, C. T; d/ Q0 h
6 Q7 Y( h0 r  Q' S/ V) z下面两幅图是我看特权同学文档上面的图,关于input_delay,只有一条表达式,他在视频中只说是将fpga外的参数移到不等式的同一边,然后就得到了input_delay,这样的话,我完全感觉不到input_delay到底如何用语言(中文)来表述啊,怎么将input_delay(输入延时?)和表达式联想到一起啊。还望版主提点一下

QQ截图20140417225156.jpg (35.77 KB, 下载次数: 2)

全图

全图

QQ截图20140417225210.jpg (28.98 KB, 下载次数: 2)

表达式

表达式

QQ截图20140417230412.jpg (125.12 KB, 下载次数: 3)

QQ截图20140417230412.jpg

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13#
发表于 2014-4-18 12:50 | 只看该作者
本帖最后由 lvsy 于 2014-4-18 13:25 编辑 0 w: k6 z# c; b* N
烂泥桑 发表于 2014-4-17 23:00( {3 @! X# U6 V1 }$ L4 U, p* F
朋友你说“对于不同系统的定义是一样的”,这句话的是说他们的含义相同,还是说他们能以同一条表达式表 ...

$ }  r, a( s; `1 Y# ]  w
+ H% ^5 h+ Z0 ?& c最大输入延时如下定义:$ j/ C; r" x' l9 Z7 y8 H/ x
input delay max = Board Delay (max) – Board clock skew (min) + Tco(max)  
9 V! y. o- d- g- s) v! \5 A, ~Altera官方资料是这样表达的:
" ?8 p# i; Z3 f& P, ?. iInput maximum delay= value maximum trace delay for data + tCO of external device – minimum trace delay for clock& s8 v- L" c+ j+ R* i3 @/ ?
以你这个图来讲,Tpcb就是Board Delay, Tc2s-Tc2r就是Borad clock skew,也就是trace delay for clock,那么
* s5 K- A1 J/ V1 l: minput delay max = Tpcb(max) – (Tc2s(min)–Tc2r(max)) + Tco(max)就是成立的,你仔细体会一下。, q2 _' Y$ [# D
% p  }/ b1 p0 B; R1 H
同理得到最小输入延时:
6 o8 H$ ]( O$ z0 o+ B$ G1 uinput delay min = Tpcb(min) – (Tc2s(max)–Tc2r(min)) + Tco(min)                  ! L) X! C* A3 W
! x% T- h8 G2 C6 I  `: n8 N, o0 u
$ F. }& [' |, v9 |. R8 Z2 A

1 b; z2 i) _' R, W' y1 }( k2 {. {3 \8 i- W8 s$ M' ?
0 h3 l+ e$ Q2 I& O5 H7 x

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14#
发表于 2014-4-18 13:27 | 只看该作者
根据
( e5 m  A( l- z  V! V2 KTco_max = Tpclk – Tsu
( V% c2 ^  j) r9 CTco_min = Th
! u! o, C9 c" D$ w$ n你就可以得到input delay跟Tsu/Th之间的关系

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15#
 楼主| 发表于 2014-4-18 15:19 | 只看该作者
lvsy 发表于 2014-4-18 13:27
  s8 @- f6 {% `& d: w3 R+ [1 i根据
- O4 c" b' y) }- g$ }& LTco_max = Tpclk – Tsu
: h4 f5 s0 I3 Q& D3 t4 N, S: JTco_min = Th
7 M" r6 |7 {" e+ M+ J9 D
感谢你的回答。但是我还是有些许疑问, X& U7 o' r' e0 y9 f
1、“Tc2s-Tc2r就是Borad clock skew”,这个Borad clock skew怎么定义呢,中文应该是板上时钟偏移,但是谁是标准呢?我的意思是为什么是Tc2s-Tc2r,而不是Tc2r-Tc2s?我能不能理解为输入延时和输出延时都是以FPGA去看,以FPGA为标准?; D! _7 ~; U( H" M6 ]) [6 _

" Y. V' H  T& i8 |2、
9 B0 F$ X. M7 y; `$ J6 eTco_max = Tpclk – Tsu& P' x% p& u9 ^8 T
Tco_min = Th) D$ J! j, z7 v5 z; W9 g
是官方给出的吗?能不能说说出自那篇文档啊,我再去看看。
& v( B3 x1 q5 ?6 y
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