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请问如何从datasheet里面得到fpga 的时序约束参数

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1#
发表于 2014-4-16 10:58 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
我是个新手,在看特权同学的视频教程,在看到他的关于时序分析的公开课时,有怎么也想不明白的地方,就来问问,也不知道标题起的会不会文不对题,各位见谅。# L2 b* @" K2 O0 i. @- l+ ^

  A; M. N5 b5 i: V在这一篇文章中:http://www.61ic.com/Technology/embed/201304/48186.html
; T) x& r6 l. b. u/ D
, ]1 |* \2 ?7 d4 U/ ]. x, _特权给了一个例子,是pin to reg的一个时序例子,我对其中的
! Z. C! I% T" ITco_max = Tpclk – Tsu
) ?  h- {2 ]$ {3 r! L) z6 H- c, ]5 z1 u3 j: x4 v
Tco_min = Th- p& M+ n# I; b$ {8 C; M
深感疑惑,希望能得到各位的一些解答,另外以此为契机,也想问问各位是如何通过外部芯片的datasheet得到想要的时序参数,或者各位有没有什么学习文档可以提供,谢谢。

20130422152846707.jpg (25.53 KB, 下载次数: 6)

20130422152846707.jpg

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2#
发表于 2014-4-16 11:49 | 只看该作者
本帖最后由 lvsy 于 2014-4-16 12:24 编辑
3 H( m4 o: |6 k. Y5 G% Q2 F# y: T  M* Q: j$ c& x
这个图理解起来更容易一些。

timing.jpg (121.76 KB, 下载次数: 14)

timing.jpg

timing.jpg (121.76 KB, 下载次数: 3)

timing.jpg

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3#
发表于 2014-4-16 12:34 | 只看该作者
lvsy 发表于 2014-4-16 11:49( t  D8 [* [  a8 G- |
这个图理解起来更容易一些。
/ u/ o" o% B- r9 \5 Z/ X
图片怎么这么小?怎么删掉其中一个?

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4#
 楼主| 发表于 2014-4-16 15:10 | 只看该作者
lvsy 发表于 2014-4-16 12:347 W7 r+ u- L- H1 X8 r6 Z  \3 G
图片怎么这么小?怎么删掉其中一个?
" y+ ^( ^) M) a* a. g$ c
图片确实有点太小,难看,能不能说说图片的出处,我再去找找看。这个图片是关于什么的?

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5#
发表于 2014-4-16 15:19 | 只看该作者
烂泥桑 发表于 2014-4-16 15:10$ m; |& B, c8 @& ]$ W/ ?
图片确实有点太小,难看,能不能说说图片的出处,我再去找找看。这个图片是关于什么的?

6 z0 Z+ q& B" @' ~这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。

mnl_timequest_cookbook.pdf

312.89 KB, 下载次数: 14, 下载积分: 威望 -5

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6#
 楼主| 发表于 2014-4-16 16:10 | 只看该作者
lvsy 发表于 2014-4-16 15:19
! G( C* L( d, C这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。

" m  `  p, W  {7 O. z* r感谢,我先去看看。。。

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7#
发表于 2014-4-16 18:57 | 只看该作者
里面有参数的, 你在他手册里查 tsu  tco 会出来

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8#
 楼主| 发表于 2014-4-16 22:41 | 只看该作者
zgq800712 发表于 2014-4-16 18:57  ?# I! Y! O& v
里面有参数的, 你在他手册里查 tsu  tco 会出来

# F2 d  q7 z4 O! \  {% U* Z朋友,帮人帮到底,你能不能截个时序图,参数图,举例说明一下。我知道是为难了,但还请指点一下,小弟入门不易啊

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9#
 楼主| 发表于 2014-4-17 16:45 | 只看该作者
lvsy 发表于 2014-4-16 15:19
* V2 v9 {# p3 y' n% k这个图是关于Tco/Tsu/Th之间的关系,我把整个文档贴上来,你在其中找Figure 1-14。

0 y) g) }6 e  I! Z- A最后在自己的YY下,我感觉自己给解释勉强可以接受,这个问题就到此为止了。
: y& o' t- G) p: x. H另外我在看你发的文档的时候,可以说看的一头雾水,能请教两个问题吗?
# u+ x% s* r0 ~0 O: U, V0 J- u/ D, I1 r' T
1、文档中那些像是描述语言一样的语句是什么呢,做什么用的?
$ v; B+ F: N; t/ B: q) ^! y* Z
5 W; J2 u, G* [6 j: u% \2、文档中提到input_delay和output_delay,我在特权同学的教程里面也有看到,但是这对不同的系统(我的意思是FPGA时钟和外部ASIC的时钟的具体情况),这个input_delay和output_delay是否有同一个或者具体的定义。换句话说,就是当我获得整个系统各项的参数时,如何得知input_delay和output_delay由哪几项参数构成,从而写成表达式呢?

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10#
发表于 2014-4-17 17:19 | 只看该作者
烂泥桑 发表于 2014-4-17 16:45
, F/ I" a+ j: ^4 G. I最后在自己的YY下,我感觉自己给解释勉强可以接受,这个问题就到此为止了。
1 x9 k2 E# g" F$ h; Q4 x另外我在看你发的文档的时候 ...
) `3 c8 D$ U1 V# q. @6 [
1. 那些语句就是约束文件(*.sdc)的格式。
. f' R( v& K' w# Q! E/ b% y2. input_delay和output_delay对于不同的系统定义是一样的,但是具体值是不一样的,要根据跟FPGA相连的外部ASIC的I/O的具体参数来确定。
( W  t( M( e' V. J& d% h8 E- ninput_delay和output_delay的最大最小值跟外部器件的Tco/Tsu/Th这些参数相关。

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11#
发表于 2014-4-17 20:13 | 只看该作者
本帖最后由 zgq800712 于 2014-4-17 20:14 编辑
( h. Y3 z# n3 }5 I
烂泥桑 发表于 2014-4-16 22:418 z: b- I' l. m2 a% G. o# E
朋友,帮人帮到底,你能不能截个时序图,参数图,举例说明一下。我知道是为难了,但还请指点一下,小弟入 ...
1 k: p) _, k5 u1 O
  Z* V: O" ?- Y9 d: y) D
不用查这些了。CPLD 可能综合下100多M,
8 H$ C, T/ Q0 D- J6 H0 d/ @8 QFPGA 同一个设计多达到了200多M的Fmax的报告。
* m$ [' M  }* k) u- t6 J1 h0 r% A这些还不满足你的要求?先看看入门的,一步步来看。+ l+ Z) N! G2 M( b3 d0 R0 a6 |

, [! l+ H& s% J7 K5 e! X我可以说很多人书说上多说到timequest  ,但是基本多事照手册的来,没多少自己的见地。6 Q* `0 S% d7 j5 ]6 ^
, W! v, m4 S9 m. ~$ Q
HDL 硬件描述语言, 不是C程序设计语言, 好好想下描述语言和设计语言什么区别。; r( L; N6 R1 S2 U. k3 g3 h$ C

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12#
 楼主| 发表于 2014-4-17 23:00 | 只看该作者
本帖最后由 烂泥桑 于 2014-4-17 23:02 编辑 ( z0 U% P. }2 [+ |: T# T! b- a
lvsy 发表于 2014-4-17 17:19* d/ n7 D% ?+ _. q0 N3 k( z
1. 那些语句就是约束文件(*.sdc)的格式。* H0 a9 L* r0 O6 b, ?& @: W
2. input_delay和output_delay对于不同的系统定义是一样的, ...
  U# Z8 P& R4 B7 v' R$ _
# d% M( q. Z: i: r
朋友你说“对于不同系统的定义是一样的”,这句话的是说他们的含义相同,还是说他们能以同一条表达式表述,只是各项表达式要按具体系统具体分析,得到相应的值?
: l. I) J5 C2 Y2 V* s
2 ~2 _5 a, ^. r& X# E. n下面两幅图是我看特权同学文档上面的图,关于input_delay,只有一条表达式,他在视频中只说是将fpga外的参数移到不等式的同一边,然后就得到了input_delay,这样的话,我完全感觉不到input_delay到底如何用语言(中文)来表述啊,怎么将input_delay(输入延时?)和表达式联想到一起啊。还望版主提点一下

QQ截图20140417225156.jpg (35.77 KB, 下载次数: 5)

全图

全图

QQ截图20140417225210.jpg (28.98 KB, 下载次数: 3)

表达式

表达式

QQ截图20140417230412.jpg (125.12 KB, 下载次数: 5)

QQ截图20140417230412.jpg

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13#
发表于 2014-4-18 12:50 | 只看该作者
本帖最后由 lvsy 于 2014-4-18 13:25 编辑 % U* S0 H" w+ ?! N4 h" E/ `
烂泥桑 发表于 2014-4-17 23:00% D( k- U7 k9 o& q$ d& s) @
朋友你说“对于不同系统的定义是一样的”,这句话的是说他们的含义相同,还是说他们能以同一条表达式表 ...

9 h1 F0 t  o* N3 M5 S# l% `6 L& \! V3 B) M) C6 \
最大输入延时如下定义:
! K) G/ j5 X: m( \; Z1 Y% Binput delay max = Board Delay (max) – Board clock skew (min) + Tco(max)  
, U* w% z' U! H- j$ i6 p* GAltera官方资料是这样表达的:: ]* P  b" @: ]( L' k
Input maximum delay= value maximum trace delay for data + tCO of external device – minimum trace delay for clock
* O5 v. }+ d# x' F以你这个图来讲,Tpcb就是Board Delay, Tc2s-Tc2r就是Borad clock skew,也就是trace delay for clock,那么
: o) v- P* D6 m. yinput delay max = Tpcb(max) – (Tc2s(min)–Tc2r(max)) + Tco(max)就是成立的,你仔细体会一下。9 q' J8 Q( d; ]3 U4 k( s9 a9 D' x

9 h( n  U- S+ h' a$ D  ^3 t* s同理得到最小输入延时:
+ @+ S* D9 `% L/ n- e( kinput delay min = Tpcb(min) – (Tc2s(max)–Tc2r(min)) + Tco(min)                  & `8 z) `, u( d- A

+ U! n2 s2 i+ [) S) P: C" ?
3 {3 g& Z, F& L) W9 H+ n6 y
/ |7 _* O9 X0 {# q; s, j5 l7 P8 a! V6 H5 t0 c+ \
5 K$ O. v! p+ ~1 q

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14#
发表于 2014-4-18 13:27 | 只看该作者
根据, k2 y& M' @' L$ e2 t
Tco_max = Tpclk – Tsu
5 c/ }' |2 [- _; N9 F0 C" fTco_min = Th
: |% X" I- t& |! t, B% V你就可以得到input delay跟Tsu/Th之间的关系

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15#
 楼主| 发表于 2014-4-18 15:19 | 只看该作者
lvsy 发表于 2014-4-18 13:27
( @( P( d+ m7 B" }9 Z; y" j2 {# I根据
3 L. e, H! q: F3 P9 q7 W' ITco_max = Tpclk – Tsu* D8 S2 z1 F6 n* T5 u
Tco_min = Th

: ?2 x8 Z# J" j感谢你的回答。但是我还是有些许疑问) M; Q. E. I  G/ f: _7 _2 v
1、“Tc2s-Tc2r就是Borad clock skew”,这个Borad clock skew怎么定义呢,中文应该是板上时钟偏移,但是谁是标准呢?我的意思是为什么是Tc2s-Tc2r,而不是Tc2r-Tc2s?我能不能理解为输入延时和输出延时都是以FPGA去看,以FPGA为标准?
0 }. }/ m3 `6 ]$ }  D7 n
$ U& Q$ b, N. v, @' e7 }2、
0 Z% D& {6 c, ?7 N3 f3 m# D* ]- q% ~) jTco_max = Tpclk – Tsu
3 M& g- W* H; U( r: [2 f7 ATco_min = Th
1 s' Z" e7 W( ?是官方给出的吗?能不能说说出自那篇文档啊,我再去看看。
# G' b5 [# G3 R+ _1 ]2 m; J, O8 \
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