高速PCB设计规则总结及原因分析（转载）

apaxeda

1、PCB时钟频率超过5MHZ或信号上升时间小于5ns,一般需要使用多层板设计。
! S" J9 \8 ]. a1 ~
原因：采用多层板设计信号回路面积能够得到很好的控制。
$ ~" ]' U2 g& S' z, i% ]9 [# z' A

) c2 r. ~) ]7 u( ]1 O7 o" c2、对于多层板，关键布线层（时钟线、总线、接口信号线、射频线、复位信号线、片选信号线以及各种控制信号线等所在层）应与完整地平面相邻，优选两地平面之间。

原因：关键信号线一般都是强辐射或极其敏感的信号线，靠近地平面布线能够使其信号回路面积减小，减小其辐射强度或提高抗干扰能力。

' J& _- q3 c4 V$ @8 M$ P
: ~4 K6 C) u; C# n8 d3、对于单层板，关键信号线两侧应该包地处理。

$ t- q3 R6 X) t$ t5 |) X原因：关键信号两侧包地，一方面可以减小信号回路面积，另外防止信号线与其他信号线之间的串扰。


. q( R/ \; p! ^! L4 [6 W4、对于双层板，关键信号线的投影平面上有大面积铺地，或者与单面板一样包地打孔处理。
5 o% ?* Y3 J% }/ {2 l% j5 c
原因：与多层板关键信号靠近地平面相同。


) l! y/ R- `, Z* {0 A4 C5、多层板中，电源平面应相对于其相邻地平面内缩5H-20H（H为电源和地平面的距离）。

5 c* W  b) Y6 x3 Z2 L' G原因：电源平面相对于其回流地平面内缩可以有效抑制边缘辐射问题。
% I  L% y8 F" e7 ~% }5 c% b5 k
0 P+ k  v/ Q! s( {5 i5 ?. d) ~4 B1 H
6、布线层的投影平面应该在其回流平面层区域内。

原因：布线层如果不在回流平面层的投影区域内，会导致边缘辐射问题，并且导致信号回路面积增大，从而导致差模辐射增大。
$ g& A6 o  O1 V1 D

( ^" b" |. L' W& H4 f7、多层板中，单板TOP、BOTTOM层尽量无大于50MHZ的信号线。

; r+ r) l+ e  n0 c+ m8 f原因：最好将高频信号走在两个平面层之间，以抑制其对空间的辐射。

2 [# M3 n& I' g' [
  |& O  c# X3 O& @5 l8、对于板级工作频率大于50MHz的单板，若第二层与倒数第二层为布线层，则TOP和BOOTTOM层应铺接地铜箔。

" v; q6 J- m, g* l: k2 t原因：最好将高频信号走在两个平面层之间，以抑制其对空间的辐射。

# v, O2 q' A8 S$ k
) @: k+ H( R/ D- K# {  Q$ B# G9、多层板中，单板主工作电源平面（使用最广泛的电源平面）应与其地平面紧邻。
4 D4 {+ A( L' {
原因：电源平面和地平面相邻可以有效地减小电源电路回路面积。
+ ~5 [5 y, G- h) h" ], j

10、在单层板中，电源走线附近必须有地线与其紧邻、平行走线。
" \* S( g+ D1 O* O
原因：减小电源电流回路面积。


11、在双层板中，电源走线附近必须有地线与其紧邻、平行走线。
7 p" l7 @8 O  F9 m' U" k
( m' R5 I$ J5 {  A+ i原因：减小电源电流回路面积。
8 r# w4 J7 ^0 ^& d0 |

12、在分层设计时，尽量避免布线层相邻的设臵。如果无法避免布线层相邻，应该适当拉大两布线层之间的层间距，缩小布线层与其信号回路之间的层间距。
3 L3 f- t/ n+ n) ^0 z8 i
$ e1 w- o, l7 e! M9 n9 i; R% }# A原因：相邻布线层上的平行信号走线会导致信号串扰。
3 U/ o! ?# x0 r( k" d+ b

" E* s: W- {, Y, |+ m13、相邻平面层应避免其投影平面重叠。
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原因：投影重叠时，层与层之间的耦合电容会导致各层之间的噪声互相耦合。


14、PCB布局设计时，应充分遵守沿信号流向直线放臵的设计原则，尽量避免来回环绕。

" {* r' L, V( M原因：避免信号直接耦合，影响信号质量。


9 Y. d4 G- L& E# [7 I15、多种模块电路在同一PCB上放臵时，数字电路与模拟电路、高速与低速电路应分开布局。
2 Q* F4 M: l. [. Y* u8 K: @( n, `
原因：避免数字电路、模拟电路、高速电路以及低速电路之间的互相干扰。
# d& `5 W2 m3 T# D: ]& p1 V

! C5 _* G3 s- C: k0 Q9 g16、当线路板上同时存在高、中、低速电路时，应该遵从高、中速电路远离接口。
$ O  [; \) A% T% S7 H/ L+ j
! z+ C- L2 m* e原因：避免高频电路噪声通过接口向外辐射。
( y$ }) G$ H* z1 n
0 l) B( l& W$ F6 o: `% K' m
17、存在较大电流变化的单元电路或器件（如电源模块:的输入输出端、风扇及继电器）附近应放臵储能和高频滤波电容。
( i) I0 X+ a0 L; N' n
原因：储能电容的存在可以减小大电流回路的回路面积。
; y: Y* y; i, h- g; Z) [4 `, \
' H5 `& ~1 e5 @
18、线路板电源输入口的滤波电路应靠近接口放置。
" S9 B2 |1 Y5 B, y
6 ~/ T7 F5 H* Z6 T* m: `原因：避免已经经过了滤波的线路被再次耦合。
" V+ c6 d/ F$ f: x
: S* _, B5 |' I5 e
19、在PCB板上，接口电路的滤波、防护以及隔离器件应该靠近接口放置。
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原因：可以有效的实现防护、滤波和隔离的效果。
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# T  L# Q: Q! Z0 d/ G" U
3 _; |  f7 s. U, L* m# r20、如果接口处既有滤波又有防护电路，应该遵从先防护后滤波的原则。

原因：防护电路用来进行外来过压和过流抑制，如果将防护电路放臵在滤波电路之后，滤波电路会被过压和过流损坏。
) M! y! B0 y; x" `
+ G5 X; y- n+ u& s1 ^; K6 z. Z( Q
21、布局时要保证滤波电路（滤波器）、隔离以及防护电路的输入输出线不要相互耦合。
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原因：上述电路的输入输出走线相互耦合时会削弱滤波、隔离或防护效果。
! `8 O+ H/ T& \- \3 ~0 `* s
! U. z. B, P( R* b1 I
22、单板上如果设计了接口“干净地”，则滤波、隔离器件应放臵在“干净地”和工作地之间的隔离带上。
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2 F9 q+ w9 g% d+ v8 E3 b原因：避免滤波或隔离器件通过平面层互相耦合，削弱效果。
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2 l2 ?1 R7 x/ J) @6 p6 A
23、 “干净地”上，除了滤波和防护器件之外，不能放置任何其他器件。
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原因：“干净地”设计的目的是保证接口辐射最小，并且“干净地”极易被外来干扰耦合，所以“干净地”上不要有其他无关的电路和器件。
, N2 w  e+ j  n+ w$ Z% }  |7 b! S

; `9 ~( |6 @8 ]' p24、晶体、晶振、继电器、开关电源等强辐射器件远离单板接口连接器至少1000mil。

! u9 }; r) F* X: a" f9 Z原因：将干扰会直接向外辐射或在外出电缆上耦合出电流来向外辐射。
* i0 ^" C  z8 f* Q, X- }, P

25、敏感电路或器件（如复位电路、:WATCHDOG电路等）远离单板各边缘特别是单板接口侧边缘至少1000mil。

原因：类似于单板接口等地方是最容易被外来干扰（如静电）耦合的地方，而像复位电路、看门狗电路等敏感电路极易引起系统的误操作。


26、为IC滤波的各滤波电容应尽可能靠近芯片的供电管脚放臵。
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( p2 J3 d% e2 G( E; b+ W, a原因：电容离管脚越近，高频回路面积越小，从而辐射越小。
# V- `, I/ ?7 C

27、对于始端串联匹配电阻，应靠近其信号输出端放臵。

原因：始端串联匹配电阻的设计目的是为了芯片输出端的输出阻抗与串联电阻的阻抗相加等于走线的特性阻抗，匹配电阻放在末端，无法满足上述等式。
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. g. Z- A4 J% H- h" |
28、PCB走线不能有直角或锐角走线。

+ M1 z/ S+ l1 }' ?1 e& i. ?原因：直角走线导致阻抗不连续，导致信号发射，从而产生振铃或过冲，形成强烈的EMI辐射。
! v+ o8 c8 B1 `( A
0 i$ Q; G5 K' [0 A, D0 l
1 w( J) ]# u/ @9 _29、尽可能避免相邻布线层的层设臵，无法避免时，尽量使两布线层中的走线相互垂直或平行走线长度小于1000mil。

原因：减小平行走线之间的串扰。

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30、如果单板有内部信号走线层，则时钟等关键信号线布在内层（优先考虑优选布 线层）。
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原因：将关键信号布在内部走线层可以起到屏蔽作用。
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# T7 F* e: l% c  I# a- K
31、时钟线两侧建议包地线，包地线每隔3000mil打接地过孔。
& ~. {% G. K# S$ L! T* K
原因：保证包地线上各点电位相等。


1 @7 W4 D3 w8 P. f7 `) I' w+ a9 U32、时钟、总线、射频线等关键信号走线和:其他同层平行走线应满足3W原则。
! W& B) j% ]- r# Z
原因：避免信号之间的串扰。
7 q8 e( \4 c# a( N, C! T1 I0 B& N
( ~0 r9 b9 o$ ^3 F8 K6 D3 e
7 l' F" x$ E9 w4 V33、电流≥1A的电源所用的表贴保险丝、磁珠、电感、钽电容的焊盘应不不少于两个过孔接到平面层。
0 a/ ]0 n; j9 v
2 z2 s1 V8 m& O0 V& t# a% w. ~原因：减小过孔等效阻抗。

34、差分信号线应同层、等长、并行走线，保持阻抗一:致，差分线间无其它走线。
9 Y; G- r+ }8 X+ H
原因：保证差分线对的共模阻抗相等，提高其抗干扰能力。
. y" @9 p5 g+ _* S0 n
$ |2 g# `- Z. c5 C
- X. ]" ]7 E6 V2 e8 n! \; ?& Q1 ^35、关键信号走线一定不能跨分割区走线（包括过孔、焊盘导致的参考平面间隙）。

原因：跨分割区走线会导致信号回路面积的增大。
9 C4 E! ^9 o& G6 W( t6 R; I

36、信号线跨其回流平面分割地情况不可避免时，建议在信号跨分割附近采用桥接电容方式处理，电容取值为1nF。

原因：信号跨分割时，常常会导致其回路面积增大，采用桥接地方式是人为的为其设臵信号回路。
& Q* W, t; ?3 U4 f- w7 `

& e7 l& S  c, _0 ^! L3 j37、单板上的滤波器（滤波电路）下方不要有其他无关信号走线。
+ W3 C4 d. O0 e; D7 L
原因：分布电容会削弱滤波器的滤波效果。


38、滤波器（滤波电路）的输入、输出信号线不能相互平行、交叉走线。
  |  g- X! p( A2 t8 [
3 u' C6 j. M- u9 e7 B4 ]原因：避免滤波前后的走线直接噪声耦合。

1 R* a2 A: G( ]
* {2 E2 Q$ ]! u& E* U* P39、关键信号线距参考平面边沿≥3H（H为线距离参考平面的高度）。

9 S0 U2 B# k' J5 s  p原因：抑制边缘辐射效应。

$ \! h0 M8 l, K1 {/ L
40、对于金属外壳接地元件，应在其投影区的顶层上铺接地铜皮。

原因：通过金属外壳和接地铜皮之间的分布电容来抑制其对外辐射和提高抗扰度。


9 c% k& T- H* x: }8 I  y8 p41、在单层板或双层板中，布线时应该注意“回路面积最小化”设计。

原因：回路面积越小、回路对外辐射越小，并且抗干扰能力越强。
+ U$ D5 H. Y) w4 z/ Y* g1 P& L" e* O

42、信号线（特别是关键信号线）换层时，应在其换层过孔附近设计地过孔。

2 S# r* e/ I# E原因：可以减小信号回路面积。


% L* {* `" P( s/ u0 R: D43、时钟线、总线、射频线等:强辐射信号线远离接口外出信号线。

原因：避免强辐射信号线上的干扰耦合到外出信号线上，向外辐射。


44、敏感信号线如复位信号线、片选信号线、系统控制信号等远离接口外出信号线。
9 \# V2 C6 p, u( V/ ]  I1 c9 T
- X* Y- e8 C- Y- u# f- _, Q原因：接口外出信号线常常带进外来干扰，耦合到敏感信号线时会导致系统误操作。


) {' k# I( ^. _45、在单面板和双面板中，滤波电容的走线应先经滤波电容滤波，再到器件管脚。

, L0 {. b- J4 Y8 C原因：使电源电压先经过滤波再给IC供电，并且IC回馈给电源的噪声也会被电容先滤掉。

& n: Q: ^' x, [+ y- C7 f" o+ p
. H5 H4 ]' h4 u- P% Z2 Q46、在单面板或双面板中，如果电源线走线很长，应每隔3000mil对地加去耦合电容，电容取值为10uF＋1000pF。

& d5 e) Z) |3 Y, }3 F原因：滤除电源线上地高频噪声。


2 n; I* s$ G- Q( d47、滤波电容的接地线和接电源线应该尽可能粗、短。

原因：等效串联电感会降低电容的谐振频率，削弱其高频滤波效果。

917406525

感谢分享            

amao

早期经验总结，有点模糊，没有量化指标。规则是死的，人是活的。
经验能分享不错。

jinbo

非常感谢您总结的经验 呵呵

吴尚真

very good

xtjo

谢谢分享

可坏

挺赞的t

popcup512j

mark一下晚上来看看。只是这个背景是lz弄得吗？太影响看字啦。

liuws

very good

myhome43

努力升等中

zengfanhua123

这个背景啊，伤神  

weichen743

内容很赞~至于背景。。。

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666666666666666

宝爱颖

大牛

没有纹身的野人

谢谢