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楼主: Timjiang
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RK2918__DDR3__LAYOUT重点事项

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该用户从未签到

18#
发表于 2015-5-6 21:22 | 只看该作者
谢谢楼主无私。。。

该用户从未签到

20#
发表于 2015-6-12 16:36 | 只看该作者
针对性有点片面,不过希望能做个参考,还是感谢楼主分享

该用户从未签到

22#
发表于 2015-6-12 23:04 | 只看该作者
莫怕滚打,吸收百家精华

该用户从未签到

23#
发表于 2015-6-15 15:00 | 只看该作者
学习学习O(∩_∩)O~

该用户从未签到

25#
发表于 2015-6-17 16:47 | 只看该作者
学习学习!谢谢分享啦!

该用户从未签到

30#
发表于 2015-7-13 09:39 | 只看该作者
"B) 据实测分析,CLK 需要做200ps 左右的附加延时才能与# X5 ]; n$ i+ q
Address/Command、Control 时序对齐。所以,要求PCBLayout 时2 X7 x. X* V) {  A
CLK 差分对应比Address/Command 、Control 长
8 {( I" X  {! h  x2 I$ R1 b1000mils~1200mils。"            CLK 线需要长这么多吗?
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