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[Ansys仿真] designer学习求助贴

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1#
发表于 2012-8-20 17:18 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
本帖最后由 beyondoptic 于 2012-8-22 17:57 编辑 " X& f* o$ ~5 Q2 z# Q

! D  L$ T' ~& b6 C1,请问一下一般仿真SSN是用什么软件仿真的?7 f. L8 m/ Q, `+ {

/ I) S: `! `/ _: T2,我从星空电子上下载了一个仿真SSN的工程文件,是用designer做的(见附件)。这个工程文件有些地方不明白
' v; b3 I& e+ ~) I/ l7 S# v2 W. w   工程文件有很多地方是断开的,比如U27 D1就是输出的buffer是断开的,接收端D2 D3和接收端的buffer也是断开的,这三 个地方为什么会断开?

ssn.rar

34.27 KB, 下载次数: 10, 下载积分: 威望 -5

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发表于 2014-1-15 10:38 | 只看该作者
提醒一下初学者,这个例子中作者在s参数模型上输入和输出对应有点错误,正确应该是U27_12对应U37_4,U27_11对应U37_15,U27_10对应U37_5。否则出来的波形逻辑上有错误。

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2#
发表于 2012-8-20 18:28 | 只看该作者
一般SSN的仿真是由电磁场仿真软件和时域链路仿真软件组合来仿真的,类如ansoft的siwave和designer(或者是Hspice,ADS等等),当然也有仿真软件把它们做到了一起省了客户倒数据的麻烦,比如sigrity,可以参考一下这个帖子里的讨论:https://www.eda365.com/thread-65884-1-2.html+ e; F! Q+ E7 Y# Z

7 K0 U  p$ u, F) `: q: l) t& z! [2 C3 _6 e
那个buffer输出或者输入线的断开确实是断开的,但是仅仅是线断开,他在断开的两端都写了一样的net名,通过net名把两端连了起来,像画原理图那样,仔细看下可以发现。
5 [6 F2 `, o+ L/ d
# Z- c, |1 g1 ~, O) [" n' f% F9 R' o1 G8 |% {

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3#
 楼主| 发表于 2012-8-21 08:39 | 只看该作者
我有想过他们名字是一样的是不是连在一起的,只是对这个软件不是很熟。
/ ]  w+ O6 L/ C2 S! U& V' n
. z% R" G9 o! L# @5 D8 s如果他们都链接起来的话,接收端应该还包括串扰吧,三组线在一起,串扰也会传到接收端。probe是信号和电源平面的之间的电压,但有时候电源平面也可以作为信号回流的参考平面啊。

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4#
 楼主| 发表于 2012-8-21 08:44 | 只看该作者
另外sigrity仿真SSN确实比较容易,不过内部算法应该和这个差不多吧,不知道我把串扰想进去是不是想多了

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5#
发表于 2012-8-21 08:48 | 只看该作者
当然有串扰啊,只不过串扰幅度是大还是小的问题

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参与人数 1贡献 +4 收起 理由
beyondoptic + 4 灰常感谢

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6#
 楼主| 发表于 2012-8-21 09:26 | 只看该作者
看了sigrity板块那个帖子,确实是软件自动界面友好的就不知道软件后台怎么做的,designer可能麻烦点会对软件怎么去仿真SSN会了解一些。建议大家能给熟练运用两到三个平台。

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7#
 楼主| 发表于 2012-8-22 15:55 | 只看该作者
斑竹如果我自己加的是IO buffer6 Z# u( R% E7 d2 ~* F
那我每个pin要怎么接啊?{:soso_e115:}

Snap1.jpg (19.67 KB, 下载次数: 7)

Snap1.jpg

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8#
发表于 2012-8-22 16:47 | 只看该作者
beyondoptic 发表于 2012-8-22 15:55
- x" g5 M& @- A- C斑竹如果我自己加的是IO buffer9 u9 Z: Y# ]5 [" W& C4 Q9 }1 e# \, u
那我每个pin要怎么接啊?

/ {" T) r9 r$ L) o0 B  B囧了,不是一样接么,该接电源的接电源,该接地的接地,该接信号的接信号,该接使能的接使能,该接输出的接输出,不过记得要将模型属性里的“power=on”改成“power=off” ,为啥要这么改请轻移莲步至该贴https://www.eda365.com/thread-65410-1-2.html

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9#
 楼主| 发表于 2012-8-22 17:46 | 只看该作者
{:soso_e127:}& `( o$ F: K$ ?* x! I7 `

$ v: J+ l3 j; r7 a- S我说一下连接方法斑竹帮忙确认下:4 b% U3 {' S9 \
1接plus4 k7 L3 H7 p. K$ X4 l/ n
2 5可以悬空, F2 P- C2 a  \) G  I
6接一个芯片的直流电平  w6 U: G! W& e) Q
3接芯片的信号脚
& I/ a, B+ F8 r7 O4接芯片的power脚0 e0 Y' k8 x0 h* {

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10#
发表于 2012-8-22 18:42 | 只看该作者
beyondoptic 发表于 2012-8-22 17:46
% O6 _6 S, N5 E) Z0 @我说一下连接方法斑竹帮忙确认下:3 N6 K  @" p. H) D! E
1接plus
6 U% s1 x! @: G, L6 M0 ^2 5可以悬空
) c% a  u9 I- R, \
错了9 h3 S, D- f8 f+ t5 p& ~

7 @# r! y: Q. C, W* m; {1接激励信号# G( |0 u; H5 m; v1 P% G5 v
2接从S参数引出来的供电电压) J* m% a% E) h* F
5接地
! c, B( ]# W- s& R2 [; L+ R6是使能脚,接低电平输出还是高电平输出看模型里的定义! J; g9 W2 K. N* J' Z( k( j0 J$ {
3为信号的输出或者输入: U/ {* N  q, M
4可以悬空

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参与人数 1贡献 +10 收起 理由
beyondoptic + 10 谢谢,结合Hspice调用IO buffer用法和斑竹说.

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11#
发表于 2012-8-23 09:28 | 只看该作者
本帖最后由 某人马甲 于 2012-8-23 09:47 编辑
5 F, [. H2 d; C
; @, P5 q. f: u+ A8 V7 Z5 H& z我顺便问下designer6的Solver on Demand具体什么意思,怎么应用啊斑竹

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12#
 楼主| 发表于 2012-8-23 09:56 | 只看该作者
斑竹如果IO做输入的话1pin也应该悬空吧?

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13#
发表于 2012-8-23 10:08 | 只看该作者
beyondoptic 发表于 2012-8-23 09:56
0 u) g6 e6 ^& A7 V7 H  ?4 g! S1 H斑竹如果IO做输入的话1pin也应该悬空吧?

& s, q) p! [' r3 K7 t做输入端可以悬空,做输出端要是不加激励源就是悬空

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14#
发表于 2012-8-23 10:08 | 只看该作者
某人马甲 发表于 2012-8-23 09:28 1 f: h5 @/ G, E$ M4 l5 L0 }/ W3 L6 |: P
我顺便问下designer6的Solver on Demand具体什么意思,怎么应用啊斑竹
; }% y& O; n3 s1 d$ }0 v9 n  Z
没看懂啥意思啊

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15#
 楼主| 发表于 2012-8-23 10:41 | 只看该作者
    [warning] models:vsource(warning): b_io6_17.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:00 上午  八月 23, 2012)4 J$ e+ M) H. x
    [warning] models:vsource(warning): b_io6_2.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:01 上午  八月 23, 2012)
: W$ c+ x, E$ A0 a3 m3 s- B    [warning] models:vsource(warning): b_io6_20.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:01 上午  八月 23, 2012): \. X' j/ k6 r- l* ]9 W2 M
    [warning] models:vsource(warning): b_io6_23.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:01 上午  八月 23, 2012)
4 C! ]/ v# t) P" c8 D    [warning] models:vsource(warning): b_io6_5.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:01 上午  八月 23, 2012)
; ~) t  t8 n" J2 s3 \    [warning] models:vsource(warning): b_io6_8.dc_src_pd - eliminating self-looping zero valued DC voltage source (10:39:01 上午  八月 23, 2012)# h# `" Y! E* H5 b' V4 p( |
这个警告是神马意思啊- ~$ X. w( F- C& h! V! t, ^
  
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