SI仿真最后一步，关于VIA的。

hero57901122 · 发表于 2012-6-19 15:40

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就是如图片所示的警告，未发现VIA的MODel,但是图2我已经设置有了MODEL，为什么会发生图1的警告。

hero57901122 · 发表于 2012-6-20 10:55

为什么都没人回答了，在仿真前是有VIA找不到库的选项，都不知道怎么下去了

hero57901122 · 发表于 2012-6-20 11:59

额自己解决了

jianhong0425 · 发表于 2012-7-19 15:27

hero57901122 发表于 2012-6-20 11:59 . g4 O% E/ Q$ c9 `. H0 P! V* `
额自己解决了

楼主是怎么解决的？自己另外建VIA的模型了吗？
VIA model里面设置detail closed from,可以自动生成VIA的模型，不知打楼主是用哪种方法？
自己在SIgxplorer里面建VIA模型怎么没有设置R C的？

hero57901122 · 发表于 2012-7-20 16:45

jianhong0425 发表于 2012-7-19 15:27 2 l6 h0 f! f- w3 _& N ~" \4 g1 N
楼主是怎么解决的？自己另外建VIA的模型了吗？
& \+ p! {9 ?; j7 L; }% h$ {VIA model里面设置detail closed from,可以自动生成VIA的 ...

你说的是什么意思

capali · 发表于 2012-12-9 15:30

删除，重建即可

binbinqq88 · 发表于 2016-2-23 16:02

学习学习

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[Cadence Sigrity] SI仿真最后一步，关于VIA的。

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