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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 问一个关于排阻为什么拓扑提取的时候不出现的问题
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问一个关于排阻为什么拓扑提取的时候不出现的问题

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美味蔬菜

该用户从未签到
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1#
发表于 2012-6-8 16:26 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我在做allegro的DDR仿真，在DDR两端接上排阻，也在creat model的时候加入model，为什么再提取DDR_ADDR的拓扑的时候这个排阻没有呢？) V7 V- q3 C. \0 `/ I  A
图片为设置model  X4 a+ A4 g& }, N7 O7 c

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美味蔬菜

该用户从未签到
2#
 楼主| 发表于 2012-6-11 17:00 | 只看该作者
up下，还是不知道为什么

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