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如何看懂别人写的很长的VHDL代码

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该用户从未签到

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1#
发表于 2012-3-22 09:15 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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别人写的很长的代码里面有很多小模块,每个小模块里有很多自定义的信号,自定义的信号多了我就看不懂了啊,请高手指点迷津
! A  _4 H* k- |( L1 S

该用户从未签到

2#
发表于 2012-4-27 23:31 | 只看该作者
1、先从主模块接口看起,最后动手将其结构画出来
9 L/ g2 I- d/ Q7 B6 D0 W$ d3 T2、将次模块的接口和主模块输入输出对应起来,其他模块方法类似5 g+ e1 K+ ^# i/ b( i6 E8 p- C( W
3、对于各种寄存器,你要弄明白各个寄存器的作用以及接口2 m, U' [0 Q8 }3 g
4、过程中使用状态机的比较常见,你要区分次态逻辑的转换条件/ \2 o' T$ x; o$ K1 K
要想学好,还是多动手,多思考,多参考标准程序,养成良好的书写习惯,看起别人写的程序也就容易了

该用户从未签到

3#
发表于 2012-5-19 08:32 | 只看该作者
最好是自己按照别人的模块画一个大致的框架连接图,看清数据的流向 再去分析每小块的功能

该用户从未签到

5#
发表于 2015-8-13 21:40 | 只看该作者
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