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为什么单片机管脚设计成低电平才有效?

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发表于 2023-2-14 17:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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它是由常用的电路结构所决定的,低电平时电路往往有较高电平时更低的环路阻抗,而低阻抗则意味着抗干扰能力更强。
( e: n2 V- o7 Z& z  p4 n8 A8 Z- @( T2 t7 n' ^5 G! k: B  r/ \7 ^; L, O2 K: o6 M

/ x5 [# L  v5 n结合实际讲一个有用的例子来加深印象:' X$ s; w" |4 A
& d/ a& K# k2 t: b6 b4 J有的同学可能已经学习了这样的一条PCB布线规则-----在条件许可的情况下,高电平有效线要尽量缩短,低电平有效的线则尽量延长----这一条规则的存在基础就是基于低电平时环路阻抗比较低,抗干扰能力比较强才起来的。: p; e$ ]# }5 ^: w+ P  U& k( g+ q4 K8 r' A  r) P

  p1 G! l7 o0 B& h8 |8 U
$ w1 N8 p) }! |# @/ I- E4 ]& P5 F
4 M7 q& a! R. V6 @如OC或OD电路要控制一个电平就是通过它这个开关的通断来实现的。
4 H' q* o3 U2 n) `) C1 m) K+ ~; L) Z/ b0 x* _* i0 L0 c7 V

# K  L1 S0 ?" j6 v! `' \* ~有在上拉电阻的情况下,开关接通,得低电平;开关切断,得高电平。这样,为了防止电路失控的情况下仍然是有效电平,那么当然是低电平有效才更“保险”了。结构上,象OC电路那样,由于集电极更难击穿,所以,也更不容易损坏。& |! n' t5 P& f. |3 P
对于其它图腾柱输出的电路,虽然0和1都有同样的风险,但应用中还是有人愿意加一个上拉电阻,以取得类似OC或OD输出的效果。至于为什么不采用下拉电阻而用上拉电阻,大家也可以分析一下。# v. O, q' M% L% N
0 ^! i4 s9 U, N) k/ J0 y& U+ j3 e5 }6 G8 i) V, B2 G0 u+ R' N
& x# W3 k# D" h& ?/ @) ^) e9 ?. J# p& s  q
另一个方面是OC或OD输出的电路,使用上拉电阻后具有节能的效果。因为关断后它是具有获得高电平时的电流几乎为0。

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