在实际项目中大家会打开除0异常的trap吗？

T_Ching

ARM M7中除0异常默认不会被trap，而只是会返回0，这样设计的原因是什么？

# I4 E6 e3 E+ L1 b2 i1 e+ N在实际项目中，大家会打开除0异常的trap吗

lahhse

可以调试时打开，量产时关闭，或能上报错误日志。
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rergr

在应用程序里，涉及到除法操作，一定要先判断分母是否为0，不要盲目用除法。异常返回0是不想让整个系统崩溃掉。一个产品被 trap 不是一个好产品。