TA的每日心情 | 衰 2023-11-22 15:02 |
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本帖最后由 Heaven_1 于 2022-10-24 16:47 编辑
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我们知道一般的IC组件通常只有两个电源引脚,一个是Vcc或Vdd,另一个是Gnd或Vss。
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6 Y& R6 v. Z* X" t6 i8 R* D但今天的mcu通常有多组电源引脚。
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为什么?& `! j4 b7 ?8 u g4 E ?8 o
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: ]; n( _" O. [$ x1 k3 O2 l; P5 T' ^7 q* f u: P; `6 _( r0 K: L
以某100针MCU为例,可以看到它有5组VDD/VSS,单片机(MCU/MPU/SOC)并且会要求每组VDD/VSS都要连接,其实多组VDD内部是相互连接的,在这种情况下,那么为什么不直接把一组芯片厂商排除出去呢?3 i/ c6 [6 t* n6 `8 C8 l$ w: l
* t8 A* }: Q, m4 l, V! _$ l或者即使还有多组人,我们能不能只带一组出去?
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如果可以用这种方式节省引脚,外部连接线也就少了。; |: a4 O8 B; J* Q6 K' m
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# S0 T1 T( a7 m/ [! o( z/ @: C$ D如果只有一个VDD连接到外部,电流在芯片内部的路径相对较长,如下面的红线所示。
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3 b4 a, A/ h6 f* N6 d- j( [& q( x对于高频电路来说,VDD的电流会在高频时发生突变(因为频率越高,需要的电流就越大),嵌入式-cpld(复杂可编程逻辑器件)这时在路径上的电感的变化就会阻止电流的变化,越长的路径阻抗越大,这样电流的阻断作用就会更明显,导致芯片在网络中的电压变化,这就会影响MCU系统的正常工作。
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对于低频或直流电路,路径的长度影响不大。
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所以在早期的低频MCU中,只有一个VDD。
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0 ? s% B9 {' ~, V0 B2 ^多组VDD可以减小电感效应(电感并联总电感变小,路径越短电感越小)。
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可以把为芯片供电的过程想象成灌溉农田。5 F) @3 x7 u! Y5 L' a
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如果只有一个进水口,不如多个进水口。
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N2 @& b4 ]( f除此之外,还有几点:
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! N D' u6 d, m" n1) MCU的模拟外设,如ADC,通常是独立电源VDDA。
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这是因为ADC需要尽可能清洁的电源来保证转换结果的准确性,嵌入式-PLD(可编程逻辑器件)独立的电源可以避免其他电源噪声的干扰。
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& E) b0 p7 Y$ Y9 z. C0 }+ _0 N& N2)多种电压要求。
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有时,芯片的不同部分在不同的电压下工作。
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一个典型的例子是低压核和高压I/O。3 L* h! q9 E, P, T
! @% q- w+ E) A J% a- g内核使用较低的电压以降低功耗,I/O运行在较高的电压下以更好地连接到外部电路。
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6 U0 t* i& h# A! i; ?3 M这时还需要分离出多组电源,常见的是一个复杂的SOC芯片。
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3)与单个VDD相比,通过VDD引脚的电流会减少,引脚不需要承受过大的电流,增强了可靠性。
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