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[Cadence Sigrity] 几颗DDR3 芯片走线怎么实现走线,打VIA一致

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1#
发表于 2011-12-19 10:38 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近在做一个TI的板子, 使用到8颗 X8的DDR3颗粒,发现公版上给出的layout图 ,每个芯片的走线 打过孔的位置都是一样的 ,请教一下这样是怎么在allegro中是怎么实现的啊  
- j& @6 h4 L( Y" m# Y9 A4 M- m# x" a+ O9 ~: Y
就先图中的那样

截图00.png (19.58 KB, 下载次数: 8)

截图00.png
  • TA的每日心情
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    2024-2-21 15:59
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    [LV.8]以坛为家I

    2#
    发表于 2011-12-19 10:54 | 只看该作者
    做好一个,然后复制过去。

    该用户从未签到

    3#
    发表于 2012-2-14 09:52 | 只看该作者
    有skill可以一个布好了,其他几个都全部一起布好,不过需要原理图也一样规范,相对位置一样。

    该用户从未签到

    4#
    发表于 2012-3-5 17:14 | 只看该作者
    reuse

    该用户从未签到

    5#
    发表于 2013-11-25 22:23 | 只看该作者
    做好一个 。复制走线和过孔,user pick模式,找个基准PAD,粘贴即可

    该用户从未签到

    7#
    发表于 2014-7-21 20:19 | 只看该作者
    create muoudle !resure !
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    2024-3-18 15:56
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    [LV.3]偶尔看看II

    8#
    发表于 2014-9-11 22:41 | 只看该作者
    nanapapaa 发表于 2012-2-14 09:529 |7 t$ L1 g" |+ l
    有skill可以一个布好了,其他几个都全部一起布好,不过需要原理图也一样规范,相对位置一样。

    & C1 \- U3 W) _" j+ a4 J7 u大哥,是什么skill这么牛,分享一下

    该用户从未签到

    9#
    发表于 2014-11-13 12:46 | 只看该作者
    这个可以使用布局复用的功能,很多教程都有,楼主可以试一试

    该用户从未签到

    10#
    发表于 2015-1-21 18:13 | 只看该作者
    好久不用,又忘记了

    该用户从未签到

    11#
    发表于 2015-1-29 09:14 | 只看该作者
    布局复用的功能,对于简单的很好使用,但DDR3之类 好像使用起来还是很困难的
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    12#
    发表于 2020-7-11 22:43 | 只看该作者
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