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[仿真讨论] DDR地址线比数据线长可以吗?

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1#
发表于 2011-11-27 23:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在做一块DDR2的板子,地址线与控制线,向时钟线等长,数据线向DQS等长,但是时钟线比DQS大约长5MM,这样可以吗?

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2#
发表于 2011-11-28 11:07 | 只看该作者
貌似不可以吧,DQS是参考时钟线的···

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3#
发表于 2011-11-28 11:27 | 只看该作者
时钟线要短 也要看情况(延时) 肯定不会长过数据线!还是听听有经验的怎么讲吧!我也学习下!我的只是个人想法!如误人子弟,请批评指出!

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4#
发表于 2011-11-29 08:41 | 只看该作者
一般来说长度排布是dq、dqs《ads、cmd、control《clk,互相之间误差在200mil。2 Q4 I2 c% h0 P/ \% D
dq、dqs、dm同组在-+25mil3 p5 y5 B5 \, {3 g5 }1 l
ads、cmd、contro之间误差在-+50

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5#
发表于 2011-11-29 17:15 | 只看该作者
DQS yu DQ 保持等长
  • TA的每日心情
    郁闷
    2025-4-28 15:02
  • 签到天数: 13 天

    [LV.3]偶尔看看II

    6#
    发表于 2011-11-30 20:47 | 只看该作者
    DQS与时钟相差最多不能超过半周期的1/10,例如DDR2-800MHZ,半周期是1250ps,1/10=125PS,这相当一根22mm走线的距离。也就是不能超过2.2cm,才是安全的。
  • TA的每日心情
    郁闷
    2025-4-28 15:02
  • 签到天数: 13 天

    [LV.3]偶尔看看II

    7#
    发表于 2011-11-30 20:48 | 只看该作者
    我比较保守取得是1/20,这里就是11mm。

    该用户从未签到

    8#
    发表于 2011-12-1 12:21 | 只看该作者
    啊哈哈,看看
  • TA的每日心情
    慵懒
    2022-4-7 15:32
  • 签到天数: 27 天

    [LV.4]偶尔看看III

    9#
    发表于 2011-12-11 16:04 | 只看该作者
    来学习学习。

    该用户从未签到

    10#
    发表于 2012-1-9 10:13 | 只看该作者
    不可以吧,DQS是以时钟做为参考的,DQ以DQS做为参考的,其他的以时钟作为参考的

    该用户从未签到

    11#
    发表于 2012-1-9 10:17 | 只看该作者
    雙魚Fei 发表于 2011-11-28 11:27 3 I/ ]/ W6 w8 y: h
    时钟线要短 也要看情况(延时) 肯定不会长过数据线!还是听听有经验的怎么讲吧!我也学习下!我的只是个人 ...

    6 E3 i. A+ o+ P" z: w; E这要看具体芯片的。一般的是时钟线》=地址线》=数据线   不过这个大于也不能超过1cm 一般在200mil为宜!

    该用户从未签到

    12#
    发表于 2012-3-22 11:37 | 只看该作者
    DDR2的数据线或者地址线 有绝对长度控制吗?
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