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[仿真讨论] DDR2 VREF 线宽要求

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1#
发表于 2011-11-24 11:39 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有些资料写的20mil。有的资料写的30mil,还有的写的电流很小,不用太宽,还有的写的不能太宽,容易收到干扰,
! G5 n9 `' E# x5 `# ]4 h$ E线宽如果太小,会有什么影响啊,线宽的容限应该是多少啊?

该用户从未签到

2#
发表于 2011-11-26 15:36 | 只看该作者
我也想知道,期待ING

该用户从未签到

3#
发表于 2011-11-28 17:12 | 只看该作者
20mil

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