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FPGA jtag烧写概率失败是由什么原因导致的?

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1#
发表于 2022-8-5 15:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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FPGA jtag烧写概率失败是由什么原因导致的?% A; w9 f( e0 G/ F8 q& Z
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    2022-1-29 15:05
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    [LV.1]初来乍到

    2#
    发表于 2022-8-5 16:49 | 只看该作者
    驱动出现了问题
  • TA的每日心情
    开心
    2022-1-21 15:22
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
    发表于 2022-8-5 16:58 | 只看该作者
    我们经常为了方便,随意插拔JTAG下载口,在多数情况下不会发生任何问题。仍然有很小的概率因为热插拔而产生的JTAG口的静电和浪涌,最终导致FPGA管脚的击穿。
    . w5 c. i& m1 k3 W5 j! S, w
  • TA的每日心情
    开心
    2022-1-21 15:21
  • 签到天数: 1 天

    [LV.1]初来乍到

    4#
    发表于 2022-8-5 17:04 | 只看该作者
    大家尽量按照以下步骤进行板子和下载线的上电、下电顺序:( s2 E) M$ p/ X
    上电顺序:
    ' `4 k6 M, e9 h1 V! Z1、在FPGA板子断电的情况下,插上JTAG下载线接口
    ) q  W/ {: O6 w" Z( I) X, k2、插上USB Blaster或者ByteBlasterII的电缆0 {0 [& f; ~9 o9 M8 x
    3、插上FPGA板子的电源  w! P  D% v$ x6 `( r
    下电顺序:
    ( o* G# R# J& x* T2 `1、断开FPGA板子的电源* Y/ f" [/ R  G0 d
    2、断开USB Blaster或者ByteBlasterII的电缆
    : t- n# q7 \) k# m: H3、断开JTAG下载线接口。
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