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Fpga ibis模型问题

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  • TA的每日心情
    郁闷
    2025-9-28 15:41
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    [LV.3]偶尔看看II

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    1#
    发表于 2022-3-19 11:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    FPGA ibis模型 用赛灵思给的原始ibis文件如何整合pcb导出来的管脚和网络对应的 model buffer?对应关系是怎样的" j/ z2 ^5 X3 r( A# K) K

    “来自电巢APP”

    该用户从未签到

    2#
    发表于 2022-3-21 09:27 | 只看该作者
    遇到同样的问题,请教大神
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    开心
    2024-2-21 15:59
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    3#
    发表于 2022-3-21 09:41 | 只看该作者
    从PCB中导出FPGA的管脚列表,替换掉原始IBIS文件中的定义,对应的 model buffer也要手工根据分配的信号类型进行编写。
  • TA的每日心情
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    2023-12-19 15:32
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    [LV.7]常住居民III

    4#
    发表于 2022-3-22 09:15 | 只看该作者
    学习到了,方便以后使用
  • TA的每日心情
    郁闷
    2025-9-28 15:41
  • 签到天数: 8 天

    [LV.3]偶尔看看II

    5#
     楼主| 发表于 2022-3-23 13:17 | 只看该作者
    dzkcool 发表于 2022-03-21 09:41:28
    $ x1 E( y! Z) T+ x5 J" q从PCB中导出FPGA的管脚列表,替换掉原始IBIS文件中的定义,对应的 model buffer也要手工根据分配的信号类型进行编写。
    + ?% i  U+ q2 ^9 J' A1 Y- c
    1 z9 X- v% V! p& C; X
    Model buffer该怎么对应呢,这么多类型,有什么方法?除了用vivado导出这种方法。
    ) B/ M2 K! g0 V+ b& {4 F: D  g0 d8 ~( ]  L4 P9 W

    “来自电巢APP”

    该用户从未签到

    6#
    发表于 2022-4-12 14:18 | 只看该作者
    对不上只能找原厂,没有原厂就凭感觉
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