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单片机未使用引脚如何处理?这样才是极佳做法

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发表于 2021-11-13 13:37 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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电路设计中,经常会遇到一些 IC 的引脚并未在应用中使用到的情况,那么,该如何处置呢?首先,当然是阅读此 IC 的产品手册,查看里面的相关介绍。其次,即便没有从中得到明确的处置信息,也不能等闲置之,我们仍需了解其功能、存在(或应该存在)的电位、可能(或必须)流进 / 流出的电流、对静电 RF 影响的灵敏度,以及是否需要其他种类的容性或阻性负载,再决定处置办法,从而保证整个系统的安全可靠。6 F5 i5 l$ A$ `) v( A) x0 u* x0 h
2 ?# h# c; v# Y/ |. r( }7 n4 J! B

3 Q9 M$ E% L9 C( U. j2 h, \单片机未使用引脚的合理处理
9 s' ~8 g6 t2 k通常我们并不会把所有的单片机的引脚都用完,有时候我们也在同一个产品上分高低配,因此如何对待一些不使用的引脚就成了一个问题。首先我们看一下单片机引脚的结构。" L1 ]( J: q* D) r+ R( x

3 t: |. P( p! m

! q$ \+ O2 F% a7 b4 q6 u* B; K2 q0 F- J

+ v# i+ g' s# V% ]  Q1 W. w  F我们可以发现,一般单片机的 IO 口都是可以配置的。3 f5 |: T' g9 F6 t' Q& p
* f$ e: O5 [8 ^1 q3 l0 _! H
CMOS 器件引脚由 N 沟道和 P 沟道场效应管,通常在一个时刻,只有一个管子是开通的,但是,有一个非常短的时间转换期,这两种管子都会部分导通,在一个管子关闭而另一个开启的时候。一个没有端接的输入口可能振荡或在一个中间电平上浮动,导致所有场效应管设备都将在一个微导通的状态,导致了管子的损耗,增加了噪声,并要消耗额外的电源电流。
  M# o2 b4 r: `% d/ R( w4 v2 t& q/ p  a6 ^1 o" l* L
(Input Only)输入专用管脚
. e) p* b- `# m' k8 ~( U0 I9 M
/ _- u( n5 V1 c2 U' q4 R1. 使用上拉或下拉电阻,将每个未使用的引脚拉到 VSS 或 VDD,这是推荐的使用方法
/ y: |# n: U1 W
  V5 K- d1 c( k2 A0 C5 O2. 捆绑在一起,并用单个电阻上拉 / 下拉到 VDD 或地,节省元件数量和成本,但是这减少了减少的灵活性。5 a5 M4 ]9 a) q6 E6 v

. S2 L( J8 ~" R
; ?7 x. k* [4 m0 o* O
(Input/Output)输入 / 输出引脚
7 g% W- c5 k( s7 l
7 \/ p6 w* m+ H& C8 j1. 每个引脚的下拉一个电阻到地(VSS)。
+ U, [% `8 r9 y$ t+ Q- j$ |
  Q% h: n: z6 A+ y' ]2. 几个引脚连下拉同一个电阻到地(VSS)。: z4 Z, W( W, E# G3 H) T, X
, V" N% s! ~2 K6 I
3. 不连接的针脚,软件程序配置 IO 口为输出口,并将它们设置为输出低。
: \7 L5 P/ L/ W' p  I' |7 |& e7 d3 q
4. 连接一个电阻到 Vss,软件程序配置 IO 口为输出低。+ w% h  x% X  ?( c& k; _

2 t- }) B8 k% t9 i# }- M5. 直接连接到地,软件程序把端口配置成高阻抗输入口,设置寄存器为输出低状态。5 b' `$ b( {3 F8 |" F

! D9 e9 u9 T6 Q% l, j$ `' e5 u& t注意这将引发双发失误导致的问题(引脚从输入到输出的变化,输出从低到高状态变化)。
. c( g3 i( B$ n& T8 D, f# f) a0 H2 ]' N. i7 u; ^, u

" h+ q3 ^  J1 O6 @- V  [( ^7 ~+ ^9 X# |0 I
! [0 ]( \7 T. ?3 Z. e8 b! U
风险在于:6 H; x1 y1 \# t1 N6 P

9 @! x( x# w$ C) N. l/ d0 @2 x* g

# L6 g' [: `/ I. ]7 A: e  G# C) m1 W# Q+ K

4 m5 s" p3 Y1 \/ b% @" t. E最后,我觉得还是每个电阻接到地比较安全。
/ P- h' D  B' ?4 p
" N" D" t+ T" M" M: j, L模拟 IC 未使用引脚注意事项! P9 H3 z, {1 Y5 D. A
模拟 IC 上的未使用引脚可能会通过静电放电(ESD)而大大提高器件过早失效的风险。尽管不用的输出端可以不用连接,而且一般也如此,但无论这个引脚是模拟的还是数字的,通常最好连接到一个电源。在单电源系统中,通常连接的是负电源,即“地”,在双电源系统中则是中间电源轨,但也有一些重要的例外情况。务必阅读浅显易懂的数据手册,按照其中的建议行事。然而,如果其中没有涉及到这一内容,接地通常是极佳做法。; C# j- S+ v0 g' h( P& M# |
  
1 B7 ]4 z( D6 f1 r& C+ a  N未使用的放大器输入端是一个重要的例外情况。将放大器未使用的输入端接地可能会增加功耗。因此,这种情况下的极佳做法,常常也是唯一安全的做法,是将放大器接成缓冲器,将该输入端连接到两个电源轨之间的某一电位。0 _+ P" ]6 q2 i& X5 I: q6 d3 K
  $ I( A7 }' K! h6 U5 `
CMOS 开关和多路复用器是对称器件,其信号输入端和输出端是可以互换的,因此所有未使用的引脚都应被视为输入,而不是输出。所以,这些引脚都应接地。
- M% K& V8 T+ D! f2 k( S3 H  
2 B3 u* M+ |+ M  ~内部上拉或下拉电阻将输入端上拉至正电源或下拉至地。如果未使用的输入端具有这样的一个电阻,则不需要进行连接。然而,如果连接该引脚,则应将它与其电阻一样连接到同一电源,因为任何其它连接都会导致电流流入电阻,带来功耗(该功耗可能相当小,但只要可能就应避免任何浪费)。
. I0 i6 U) b) j9 g3 J; c1 w# E  & }9 m, F: ^6 [) s# z( G& Z
特别要注意未使用的逻辑输入,因为在不使用时,某些逻辑输入必须连接到逻辑 1。此外,某些逻辑输入具有三种状态,而不是两种,开路条件也被定义为一种逻辑状态,这种输入可能需要保持不连接。
0 Q- A/ |' r' N. d8 c, J/ W  
2 k1 ?, ]7 a  m5 K) [总而言之,必须将未使用 IC 引脚的连接作为模拟电路设计过程的重要部分加以考虑,不可轻视。9 ?. \5 M6 o! a" p0 n/ ?3 v

/ n2 u+ q  ?% _8 ^1 CFPGA 未使用引脚的配置+ b* p8 [  |; d
在使用 FPGA 过程中,未使用引脚的配置是很重要的。一般未用管脚设置成三态输入或弱上拉输入。/ g( {6 [6 D1 S" q+ R5 Z
/ K& E/ }7 Q! N8 I, J: Z2 {3 S; G5 f
altera FPGA 为例,一般是将没使用的管脚设置为三态输入比较安全。利用 Quartus II 将未使用管脚设置为三态输入8 s2 O1 A. s/ A# a5 `9 g5 p* T8 F
. z7 W* k! u' X6 |: K

2 q! x) @+ {" _) J6 U" F  y  U! i; `6 |7 i  _; U; \: M# _

$ _; H' U; }2 y" j6 U选择 Assignments→Settings→Devices and Pin Options,打开一个选项卡,选项卡中选择 Unused Pins 就可以对未定义的管脚配置了 As input tri-stated。
- m1 _9 Z, {9 n$ S, t( S) h, d

该用户从未签到

2#
发表于 2021-11-13 14:07 | 只看该作者
  使用上拉或下拉电阻,将每个未使用的引脚拉到 VSS 或 VDD,这是推荐的使用方法
  • TA的每日心情

    2019-11-19 15:55
  • 签到天数: 1 天

    [LV.1]初来乍到

    3#
    发表于 2021-11-13 14:08 | 只看该作者
    一般单片机的 IO 口都是可以配置的

    该用户从未签到

    4#
    发表于 2021-11-13 14:08 | 只看该作者
      不连接的针脚,软件程序配置 IO 口为输出口,并将它们设置为输出低
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