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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑 ( x0 b/ }, H9 ?4 Q9 |. E: A

( K; Z+ Q9 ], ~) b5 Z      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。4 q! P: s" _6 _, ^+ l, k
2 n2 S4 T6 Z" G$ ]; R
       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
0 N* G; F- Q* Q" v+ I: ?& R: p* T
% T5 l1 O( ?& @( }      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。' K2 _7 x3 x5 i; d6 o3 V
- D: a. o/ q# j; \3 i7 j! i
     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 " g8 z6 `$ S5 D8 B0 t- F3 X
" q4 {$ ]( N- W
想问一下的就是,! R% {& y0 `- t7 k% Z2 E5 R
1.40mA的驱动电流计算是否正确?0 T" Q$ A8 p6 p3 S/ M
2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?7 A9 }6 b+ e# |. X6 {
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?# K3 I% E6 n8 E0 D( ~- z1 \& U

, J/ B/ I* y& m/ T  ^- Y+ S2 \  Y
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

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    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子% Z. B, ?3 B2 l. [9 X3 p" a- b

    ! Z) i; _1 a. h0 u" I明白,但是对面的设备信息如下:% H) I2 ?7 J5 @! Y

    3 P5 S8 L: Q0 {4 T' d* X. j! W" _
    $ C- P' w0 y7 t# y; L9 vinput impedance : 50 ohm
    " d+ Q) [9 p2 t6 o# _( Xinput level :HCT: U; ~9 A/ j2 d' s" r$ x9 t

    ! P6 ~, b4 a; W7 j所以没办法。
    3 G5 s6 X* F7 Q2 [, K
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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