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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑
! R1 j' t; x8 o. }2 s- Q' Q5 v0 R% A$ a
      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。
2 D  P; q& a/ ~; t  k, A
) v/ s, V! G) M8 T% |8 T       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.# \& h4 U: [+ S

# I$ g0 `& G: b      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。
% A! B8 d3 r6 E3 a& I% `3 C
/ [5 l' R  ]- m6 A     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。
' z, M6 `% ~6 H# P: V1 R5 N2 ~6 g; m9 W9 L
想问一下的就是,5 s+ g9 |4 V  n' k# |; T8 e" N
1.40mA的驱动电流计算是否正确?
& A. z6 H8 r$ M4 x2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?/ y& X8 ?- {# U5 {* w* K
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?
1 r2 f# V2 E2 [9 t, g
2 N' ~5 V# R1 s6 c9 j
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子
    + M, P7 J7 L# L9 N! W  z, m. m1 I( ~) H7 a9 M. ^+ A
    明白,但是对面的设备信息如下:
    # D3 `8 G9 n# ^$ F0 V$ e( p3 _6 [. l. T# z/ \" F

    * z7 G+ }" y: S. Q. Y% Z( X. Minput impedance : 50 ohm
    ! \' {- B- ~7 E9 e' Z9 p; Uinput level :HCT% e' k0 @- q8 c) ^5 _5 l. h

    0 S% P! m* R# l4 l所以没办法。
    9 `4 M, l6 i: f# E
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

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    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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