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[仿真讨论] 关于50欧姆终端并联匹配的问题

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1#
发表于 2011-6-9 12:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 hgzty 于 2011-6-9 12:48 编辑
9 [3 Z6 G5 |% h# p8 u
: l  Y+ j: i$ |      对面设备是5V TTL的输入标准 VIH:2V,有一个50欧姆的并联匹配电阻接地。信号速率在100M以下。
' m3 V1 z; s7 M! W( p  O$ P+ X0 ~# n  i4 C) g
       我的设备是这样的情况,cpld输出的是3.3V TTL/CMOS 电平。那就是说如果要能够正常驱动的话,起码要有40mA以上的驱动电流。也就是说我必须设计一个满足5V TTL输出电平又同时满足驱动能力的接口.
1 J% w6 s2 {7 T: T5 U- m/ E7 _8 S: O) T2 Y
      现在的想法是,CPLD输出的3.3V电平信号首先通过电平转换为5V TTL,再通过line driver芯片进行驱动。  ]# W! D( P9 Q- p4 ]) C
! Y  j0 @$ U1 I/ T' s* t$ E( b
     还有一种设计就是CPLD输出的CMOS 3.3V电平信号直接驱动 5V TTL的line driver芯片。 0 ]7 ^3 i5 q. F4 ^) g: J
! s' |5 X% H% F8 L
想问一下的就是,
& |/ J' Y/ E+ A' h1.40mA的驱动电流计算是否正确?+ n( v# J/ A# `8 x9 t
2.如果考虑到输出阻抗的话,那在输入端不是还会有一个分压?. J9 P7 V0 |5 j" ?; D9 ]* p6 h; s- S
3.有没有直接支持3.3V电平信号转5V 信号,且5V输出这里又有比较大的驱动电流的芯片?! S) o/ [& b/ f; h4 f- A$ V- d  m
( ~! l+ l! x$ {% K( S
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    2#
    发表于 2011-6-9 20:27 | 只看该作者
    一般情况下不会采用终端并联端接,用源端串联端接。

    该用户从未签到

    3#
     楼主| 发表于 2011-6-10 14:16 | 只看该作者
    回复 willyeing 的帖子3 c( [; i& t) M. j* G- y2 b" _
    * f' F6 b: i2 k
    明白,但是对面的设备信息如下:
    ; r0 W7 @* [4 t, U2 {
    9 |; `5 ~7 k* Z8 f+ O5 G* P2 N+ g' o. b* i
    input impedance : 50 ohm
    . _! r, E3 @$ U" h7 finput level :HCT7 N" n  ^5 N9 t9 ^

    ' g' C0 U: K# U  f, ^/ z; x4 S/ ]; }# R所以没办法。
    8 v# a: j8 @* \. ~8 {  x
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    4#
    发表于 2011-6-10 19:59 | 只看该作者
    查查ti网站上有很多这种电平驱动芯片,网站上挂了很多应用笔记,应该有满足你要求的芯片的

    该用户从未签到

    5#
     楼主| 发表于 2011-6-16 16:53 | 只看该作者
    谢谢楼上的回答,在ti上找了一圈,根据驱动电流选了ABT的器件。应该能够满足要求,想知道的是这种SN74ABT16245A的器件输出阻抗一般是多少的。
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